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参数资料
| 型号： | ID80C52CXXX-16:D |
| 厂商： | ATMEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, CDIP40 |
| 封装： | CERAMIC, DIP-40 |
| 文件页数： | 92/134页 |
| 文件大小： | 3805K |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页当前第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页
60
8068U–AVR–06/2013
XMEGA A3
Not recommended for new designs -
Use XMEGA A3U series
Notes:
1. Cycle times for Data memory accesses assume internal memory accesses, and are not valid
for accesses via the external RAM interface.
2. One extra cycle must be added when accessing Internal SRAM.
ROL
Rd
Rotate Left Through Carry
Rd(0)
Rd(n+1)
C
C,
Rd(n),
Rd(7)
Z,C,N,V,H
1
ROR
Rd
Rotate Right Through Carry
Rd(7)
Rd(n)
C
C,
Rd(n+1),
Rd(0)
Z,C,N,V
1
ASR
Rd
Arithmetic Shift Right
Rd(n)
Rd(n+1), n=0..6
Z,C,N,V
1
SWAP
Rd
Swap Nibbles
Rd(3..0)
Rd(7..4)
None
1
BSET
s
Flag Set
SREG(s)
1SREG(s)
1
BCLR
s
Flag Clear
SREG(s)
0SREG(s)
1
SBI
A, b
Set Bit in I/O Register
I/O(A, b)
1
None
1
CBI
A, b
Clear Bit in I/O Register
I/O(A, b)
0
None
1
BST
Rr, b
Bit Store from Register to T
T
Rr(b)
T
1
BLD
Rd, b
Bit load from T to Register
Rd(b)
T
None
1
SEC
Set Carry
C
1C
1
CLC
Clear Carry
C
0C
1
SEN
Set Negative Flag
N
1N
1
CLN
Clear Negative Flag
N
0N
1
SEZ
Set Zero Flag
Z
1Z
1
CLZ
Clear Zero Flag
Z
0Z
1
SEI
Global Interrupt Enable
I
1I
1
CLI
Global Interrupt Disable
I
0I
1
SES
Set Signed Test Flag
S
1S
1
CLS
Clear Signed Test Flag
S
0S
1
SEV
Set Two’s Complement Overflow
V
1V
1
CLV
Clear Two’s Complement Overflow
V
0V
1
SET
Set T in SREG
T
1T
1
CLT
Clear T in SREG
T
0T
1
SEH
Set Half Carry Flag in SREG
H
1H
1
CLH
Clear Half Carry Flag in SREG
H
0H
1
MCU Control Instructions
BREAK
Break
(See specific descr. for BREAK)
None
1
NOP
No Operation
None
1
SLEEP
Sleep
(see specific descr. for Sleep)
None
1
WDR
Watchdog Reset
(see specific descr. for WDR)
None
1
Mnemonics
Operands
Description
Operation
Flags
#Clocks
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