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参数资料
| 型号： | IDT70121S55J |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 1/15页 |
| 文件大小： | 0K |
| 描述： | IC SRAM 18KBIT 55NS 52PLCC |
| 标准包装： | 24 |
| 格式 - 存储器： | RAM |
| 存储器类型： | SRAM - 双端口，异步 |
| 存储容量： | 18K（2K x 9） |
| 速度： | 55ns |
| 接口： | 并联 |
| 电源电压： | 4.5 V ~ 5.5 V |
| 工作温度： | 0°C ~ 70°C |
| 封装/外壳： | 52-LCC（J 形引线） |
| 供应商设备封装： | 52-PLCC（19x19） |
| 包装： | 管件 |
| 其它名称： | 70121S55J |
HIGH-SPEED
2K x 9 DUAL-PORT
STATIC RAM
WITH BUSY & INTERRUPT
IDT70121S/L
IDT70125S/L
Features
◆
Fully asychronous operation from either port
?
◆
High-speed access
– Commercial: 25/35/45/55ns (max.)
– Industrial: 35ns (max.)
Low-power operation
– IDT70121/70125S
Active: 675mW (typ.)
Standby: 5mW (typ.)
– IDT70121/70125L
Active: 675mW (typ.)
◆
◆
◆
◆
◆
◆
◆
◆
MASTER IDT70121 easily expands data bus width to 18 bits or
more using SLAVE IDT70125 chip
On-chip port arbitration logic (IDT70121 only)
BUSY output flag on Master; BUSY input on Slave
INT flag for port-to-port communication
Battery backup operation—2V data retention
TTL-compatible, signal 5V (±10%) power supply
Available in 52-pin PLCC
Industrial temperature range (–40°C to +85°C) is available for
BUSY L
BUSY R
Standby:1mW(typ.)
Functional Block Diagram
OE L
CE L
R/ W L
I/O 0L - I/O 8L
(1,2)
I/O
Control
◆
selected speeds
Green parts available, see ordering information
OE R
CE R
R/ W R
I/O 0R -I/O 8R
I/O
Control
(1,2)
A 10L
A 0L
Address
Decoder
MEMORY
ARRAY
Address
Decoder
A 10R
A 0R
11
11
CE L
OE L
R/ W L
ARBITRATION
INTERRUPT
LOGIC
CE R
OE R
R/ W R
INT L
(2)
INT R
(2)
2654 drw 01
NOTES:
1. 70121 (MASTER): BUSY is non-tri-stated push-pull output.
70125 (SLAVE): BUSY is input.
2. INT is non-tri-stated push-pull output.
OCTOBER 2008
1
?2008 Integrated Device Technology, Inc.
DSC 2654/11
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PDF描述 |
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参数描述 |
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