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参数资料
型号： IDT70V631S10PRFG
厂商： IDT, Integrated Device Technology Inc
文件页数： 1/23页
文件大小： 0K
描述： IC SRAM 4MBIT 10NS 128TQFP
标准包装： 6
格式 - 存储器： RAM
存储器类型： SRAM - 双端口，异步
存储容量： 4.5M（256K x 18）
速度： 10ns
接口： 并联
电源电压： 3.15 V ~ 3.45 V
工作温度： 0°C ~ 70°C
封装/外壳： 128-LQFP
供应商设备封装： 128-TQFP（14x20）
包装： 托盘
HIGH-SPEED 3.3V 256K x 18
ASYNCHRONOUS DUAL-PORT
STATIC RAM
IDT70V631S
True Dual-Port memory cells which allow simultaneous
High-speed access
Dual chip enables allow for depth expansion without
IDT70V631 easily expands data bus width to 36 bits or
M/ S = V IH for BUSY output flag on Master,
Busy and Interrupt Flags
On-chip port arbitration logic
Full on-chip hardware support of semaphore signaling
Features
◆
access of the same memory location
◆
– Commercial: 10/12/15ns (max.)
– Industrial: 12ns (max.)
◆
external logic
◆
more using the Master/Slave select when cascading more
than one device
◆
M/ S = V IL for BUSY input on Slave
◆
◆
◆
between ports
Functional Block Diagram
UB L
LB L
R/ W L
◆
◆
◆
◆
◆
◆
◆
◆
Fully asynchronous operation from either port
Separate byte controls for multiplexed bus and bus
matching compatibility
Supports JTAG features compliant to IEEE 1149.1
– Due to limited pin count, JTAG is not supported on the
128-pin TQFP package.
LVTTL-compatible, single 3.3V (±150mV) power supply for
core
LVTTL-compatible, selectable 3.3V (±150mV)/2.5V (±100mV)
power supply for I/Os and control signals on each port
Available in a 128-pin Thin Quad Flatpack, 208-ball fine
pitch Ball Grid Array, and 256-ball Ball Grid Array
Industrial temperature range (–40°C to +85°C) is available
for selected speeds
Green parts available, see ordering information
UB R
LB R
R/ W R
B
E
B
E
B
E
B
E
CE 0L
0
L
1
L
1
R
0
R
CE 0 R
CE 1L
OE L
Dout0-8_L
Dout9-17_L
Dout0-8_R
Dout9-17_R
CE 1 R
OE R
256K x 18
MEMORY
ARRAY
I/O 0L - I/O 17L
Din_L
Din_R
I/O 0R - I/O 17R
A 17L
A 0L
Address
Decoder
ADDR_L
ADDR_R
Address
Decoder
A 17R
A 0R
OE L
ARBITRATION
OE R
CE 0L
CE 1L
R/ W L
INTERRUPT
SEMAPHORE
LOGIC
R/ W R
CE 0 R
CE 1 R
BUSY L
BUSY R
SEM L
INT L
TDI
TDO
M/ S
JTAG
TMS
TCK
TRST
SEM R
INT R
5622 drw 01
NOTES:
1. BUSY is an input as a Slave (M/ S =V IL ) and an output when it is a Master (M/ S =V IH ).
2. BUSY and INT are non-tri-state totem-pole outputs (push-pull).
?2013 Integrated Device Technology, Inc.
1
OCTOBER 2013
DSC-5622/7
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PDF描述
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