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参数资料
| 型号： | IDT71342SA35J8 |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 10/14页 |
| 文件大小： | 0K |
| 描述： | IC SRAM 32KBIT 35NS 52PLCC |
| 标准包装： | 400 |
| 格式 - 存储器： | RAM |
| 存储器类型： | SRAM - 双端口，异步 |
| 存储容量： | 32K (4K x 8) |
| 速度： | 35ns |
| 接口： | 并联 |
| 电源电压： | 4.5 V ~ 5.5 V |
| 工作温度： | 0°C ~ 70°C |
| 封装/外壳： | 52-LCC（J 形引线） |
| 供应商设备封装： | 52-PLCC（19x19） |
| 包装： | 带卷 (TR) |
| 其它名称： | 71342SA35J8 |
IDT71342SA/LA
High-Speed 4K x 8 Dual-Port Static RAM with Semaphore
Industrial and Commercial Temperature Ranges
Timing Waveform of Semaphore Read After Write Timing, Either Side (1)
t SAA
t OH
A 0 - A 2
VALID ADDRESS
VALID ADDRESS
SEM
DATA 0
t AW
t EW
t WR
t DW
DATA IN VALID
t ACE
t SOP
DATA OUT
VALID
R/ W
t AS
t WP
t DH
OE
t SWRD
t SOP
t AOE
Write Cycle
Test Cycle
(Read Cycle)
2721 drw 12
NOTE:
1. CE = V IH for the duration of the above timing (both write and read cycle).
Timing Waveform of Semaphore Condition (1,3,4)
A 0"A" - A 2"A"
MATCH
SIDE (2) "A"
R/ W "A"
SEM "A"
t SPS
A 0"B" - A 2"B"
MATCH
SIDE (2) "B"
R/ W " B "
SEM "B"
2721 drw 13
NOTES:
1. D 0R = D 0L = V IL , CE R = CE L = V IH , Semaphore Flag is released from both sides (reads as ones from both sides) at cycle start.
2. All timing is the same for left and right ports. Port "A" may be either left or right port. Port "B" is the opposite from port "A".
3. This parameter is measured from the point where R/ W " A " or SEM " A " goes HIGH until R/ W " B " or SEM " B " goes HIGH.
4. If t SPS is violated, the semaphore will fall positively to one side or the other, but there is no guarantee which side will obtain the flag.
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6.42
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