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参数资料
| 型号： | IDT71V321L25JI |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 1/15页 |
| 文件大小： | 0K |
| 描述： | IC SRAM 16KBIT 25NS 52PLCC |
| 标准包装： | 24 |
| 格式 - 存储器： | RAM |
| 存储器类型： | SRAM - 双端口，异步 |
| 存储容量： | 16K (2K x 8) |
| 速度： | 25ns |
| 接口： | 并联 |
| 电源电压： | 3 V ~ 3.6 V |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 52-LCC（J 形引线） |
| 供应商设备封装： | 52-PLCC（19x19） |
| 包装： | 管件 |
| 其它名称： | 71V321L25JI |
Features
HIGH SPEED 3.3V
2K X 8 DUAL-PORT
STATIC RAM WITH
INTERRUPTS
IDT71V321S/L
IDT71V421S/L
◆
◆
◆
◆
High-speed access
– Commercial: 25/35/55ns (max.)
– Industrial: 25ns (max.)
Low-power operation
– IDT71V321/IDT71V421S
— Active: 325mW (typ.)
— Standby: 5mW (typ.)
– IDT71V321/V421L
— Active: 325mW (typ.)
— Standby: 1mW (typ.)
Two INT flags for port-to-port communications
MASTER IDT71V321 easily expands data bus width to 16-
◆
◆
◆
◆
◆
◆
◆
◆
On-chip port arbitration logic (IDT71V321 only)
BUSY output flag on IDT71V321; BUSY input on IDT71V421
Fully asynchronous operation from either port
Battery backup operation—2V data retention (L only)
TTL-compatible, single 3.3V power supply
Available in 52-pin PLCC, 64-pin TQFP and STQFP
packages
Industrial temperature range (–40°C to +85°C) is available
for selected speeds
Green parts available, see ordering information
or-more-bits using SLAVE IDT71V421
Functional Block Diagram
OE L
CE L
R/ W L
I/O 0L - I/O 7L
I/O
Control
I/O
Control
OE R
CE R
R/ W R
I/O 0R -I/O 7R
BUSY R
BUSY L
(1,2)
(1,2)
A 10L
A 0L
Address
Decoder
MEMORY
ARRAY
Address
Decoder
A 10R
A 0R
11
11
INT L
INT R
NOTES:
(2)
CE L
OE L
R/ W L
ARBITRATION
and
INTERRUPT
LOGIC
CE R
OE R
R/ W R
3026 drw 01
(2)
1. IDT71V321 (MASTER): BUSY is an output. IDT71V421 (SLAVE): BUSY is input.
2. BUSY and INT are totem-pole outputs.
JANUARY 2010
1
?2010 Integrated Device Technology, Inc.
DSC-3026/11
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PDF描述 |
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参数描述 |
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