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参数资料
| 型号： | IDT72V3612L12PF |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | FIFO |
| 英文描述： | 3.3 VOLT CMOS SyncBiFIFO-TM 64 x 36 x 2 |
| 中文描述： | 64 X 36 BI-DIRECTIONAL FIFO, 8 ns, PQFP120 |
| 封装： | TQFP-120 |
| 文件页数： | 14/25页 |
| 文件大小： | 240K |
| 代理商： | IDT72V3612L12PF |
21
IDT72V3612 3.3V, CMOS SyncBiFIFOTM
64 x 36 x 2
COMMERCIALTEMPERATURERANGE
NOTE:
1. Port B parity generation off (PGB = LOW).
Figure 15. Timing for Mail1 Register and
MBF1 Flag
4659 drw 18
CLKA
ENA
A0 - A35
MBA
CSA
W/
RA
CLKB
MBF1
CSB
MBB
ENB
B0 - B35
W/
RB
W1
tENS1
tENH1
tDS
tDH
tPMF
tEN
tMDV
tPMR
tENS2
tENH2
tDIS
W1 (Remains valid in Mail1 Register after read)
FIFO1 Output Register
tENS1
tENH1
tENS1
tENH1
tENS1
tENH1
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PDF描述 |
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