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参数资料
| 型号： | IDT72V3612L20PF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 15/24页 |
| 文件大小： | 0K |
| 描述： | IC FIFO 64X36X2 20NS 120QFP |
| 标准包装： | 45 |
| 系列： | 72V |
| 功能： | 异步 |
| 存储容量： | 4.6K（64 x 36 x2） |
| 数据速率： | 50MHz |
| 访问时间： | 20ns |
| 电源电压： | 3 V ~ 3.6 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 120-LQFP |
| 供应商设备封装： | 120-TQFP（14x14） |
| 包装： | 托盘 |
| 其它名称： | 72V3612L20PF |
22
IDT72V3612 3.3V, CMOS SyncBiFIFOTM
64 x 36 x 2
COMMERCIALTEMPERATURERANGE
Figure 18. ODD/EVEN
EVEN
EVEN W/R
RR
RRB, MBB, and PGB to PEFB
PEFB
PEFB Timing
NOTE:
1. ENB is HIGH, and CSB is LOW.
Figure 20. Parity Generation Timing when Reading from Mail1 Register
NOTE:
1. ENB is HIGH.
Figure 19. Parity Generation Timing when Reading from Mail2 Register
NOTE:
1. ENA is HIGH.
4659 drw 21
ODD/
EVEN
PEFB
PGB
MBB
W/
RB
Valid
tPOPE
tPEPE
tPOPE
tPEPE
4659 drw 22
ODD/
EVEN
A8, A17,
A26, A35
PGA
MBA
W/
RA
Mail2
Data
Generated Parity
Mail2 Data
CSA
LOW
tEN
tPEPB
tPOPB
tPEPB
tMDV
4659 drw 23
ODD/
EVEN
B8, B17,
B26, B35
PGB
MBB
W/
RB
Mail1
Data
Generated Parity
Mail1 Data
CSB LOW
tEN
tPEPB
tPOPB
tPEPB
tMDV
相关PDF资料 |
PDF描述 |
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