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参数资料
| 型号： | IDT74ALVC16835PAG |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 总线收发器 |
| 英文描述： | ALVC/VCX/A SERIES, 18-BIT DRIVER, TRUE OUTPUT, PDSO56 |
| 封装： | TSSOP-56 |
| 文件页数： | 4/6页 |
| 文件大小： | 72K |
| 代理商： | IDT74ALVC16835PAG |
INDUSTRIALTEMPERATURERANGE
4
IDT74ALVC16835
3.3V CMOS 18-BIT UNIVERSAL BUS DRIVER WITH 3-STATE OUTPUTS
OPERATING CHARACTERISTICS, TA = 25°C
VCC = 2.5V ± 0.2V
VCC = 3.3V ± 0.3V
Symbol
Parameter
Test Conditions
Typical
Unit
CPD
Power Dissipation Capacitance Outputs enabled
CL = 0pF, f = 10Mhz
26
31
pF
CPD
Power Dissipation Capacitance Outputs disabled
12
15
SWITCHING CHARACTERISTICS(1)
VCC = 2.5V ± 0.2V
VCC = 2.7V
VCC = 3.3V ± 0.3V
Symbol
Parameter
Min.
Max.
Min.
Max.
Min.
Max.
Unit
fMAX
150
—
150
—
150
—
MHz
tPLH
PropagationDelay
1
4.2
—
4.2
1
3.6
ns
tPHL
Ax to Yx
tPLH
PropagationDelay
1.3
5
—
4.9
1.3
4.2
ns
tPHL
LE to Yx
tPLH
PropagationDelay
1.4
5.5
—
5.2
1.4
4.5
ns
tPHL
CLK to Yx
tPZH
OutputEnableTime
1.4
5.5
—
5.6
1.1
4.6
ns
tPZL
OE to Yx
tPHZ
OutputDisableTime
1
4.5
—
4.3
1.3
3.9
ns
tPLZ
OE to Yx
tW
Pulse Duration, LE LOW
3.3
—
3.3
—
3.3
—
ns
tW
Pulse Duration, CLK HIGH or LOW
3.3
—
3.3
—
3.3
—
ns
tSU
Set-up Time, data before CLK
↑
2.2
—
2.1
—
1.7
—
ns
tSU
Set-up Time, data before LE
↓, CLK HIGH
1.9
—
1.6
—
1.5
—
ns
tSU
Set-up Time, data before LE
↓, CLK LOW
1.3
—
1.1
—
1
—
ns
tH
Hold Time, data after CLK
↑
0.6
—
0.6
—
0.7
—
ns
tH
Hold Time, data after LE
↓, CLK HIGH or LOW
1.4
—
1.7
—
1.4
—
ns
tSK(O)
Output Skew(2)
——
—
500
ps
NOTES:
1.
See TEST CIRCUITS AND WAVEFORMS. TA = – 40°C to + 85°C.
2.
Skew between any two outputs of the same package and switching in the same direction.
SWITCHING CHARACTERISTICS FROM 0°C TO 65°C, CL = 50pF
VCC = 3.3V ± 0.15V
Symbol
Parameter
Min.
Max.
Unit
tPLH
PropagationDelay
1.7
4.5
ns
tPHL
CLK to xYx
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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