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参数资料
型号： IDT74ALVCH16821PV8
厂商： INTEGRATED DEVICE TECHNOLOGY INC
元件分类： 总线收发器
英文描述： ALVC/VCX/A SERIES, DUAL 10-BIT DRIVER, TRUE OUTPUT, PDSO56
封装： 0.635 MM PITCH, SSOP-56
文件页数： 2/6页
文件大小： 109K
代理商： IDT74ALVCH16821PV8
2
EXTENDED COMMERCIAL TEMPERATURE RANGE
IDT74ALVCH16821
3.3V CMOS 20-BIT BUS-INTERFACE FLIP-FLOP
SSOP/TSSOP/TVSOP
TOP VIEW
FUNCTION TABLE (each 10-bit flip-flop) (1)
PIN DESCRIPTION
NOTES:
1. Stresses greater than those listed under ABSOLUTE MAXIMUM
RATINGS may cause permanent damage to the device. This is a
stress rating only and functional operation of the device at these or
any other conditions above those indicated in the operational sections
of this specification is not implied. Exposure to absolute maximum
rating conditions for extended periods may affect reliability.
2. VCC terminals.
3. All terminals except VCC.
CAPACITANCE (TA = +25oC, f = 1.0MHz)
Symbol
Parameter(1)
Conditions
Typ.
Max.
Unit
CIN
Input Capacitance
VIN = 0V
5
7
pF
COUT
Output
Capacitance
VOUT = 0V
7
9
pF
CI/O
I/O Port
Capacitance
VIN = 0V
7
9
pF
NEW16link
NOTE:
1. As applicable to the device type.
ABSOLUTE MAXIMUM RATING (1)
Symbol
Description
Max.
Unit
VTERM(2)
Terminal Voltage
with Respect to GND
– 0.5 to + 4.6
V
VTERM(3)
Terminal Voltage
with Respect to GND
– 0.5 to
VCC + 0.5
V
TSTG
Storage Temperature
– 65 to + 150
°C
IOUT
DC Output Current
– 50 to + 50
mA
IIK
Continuous Clamp Current,
VI < 0 or VI
> VCC
± 50
mA
IOK
Continuous Clamp Current, VO < 0
– 50
mA
ICC
ISS
Continuous Current through
each VCC or GND
±100
mA
NEW16link
NOTE:
1. These pins have “Bus-Hold.” All other pins are standard inputs,
outputs, or I/Os.
NOTE:
1. H = HIGH Voltage Level
L = LOW Voltage Level
X = Don’t Care
Z = High-Impedance
-
= LOW-to-HIGH Transition
Q
0
= Indicates the previous state
PIN CONFIGURATION
1
OE
1
Q1
GND
1
Q2
VCC
1
Q 5
1
Q 6
GND
1
Q 7
1
Q 8
1
Q 9
1
Q10
1
Q 4
2
Q1
GND
2
Q 2
2
Q 3
2
Q 4
VCC
2
Q 5
SO 56-1
SO 56-2
SO 56-3
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
48
49
50
51
52
53
54
55
56
1
CLK
GND
VCC
GND
2
Q9
GND
2
Q 7
2
OE
25
26
27
28
32
31
30
29
GND
2
Q 8
1
Q3
2
Q6
VCC
2
Q10
2
D9
2
D10
2
CLK
2
D8
2
D7
2
D6
2
D5
2
D4
2
D 3
2
D1
1
D10
2
D2
1
D9
1
D8
1
D7
1
D5
1
D4
1
D3
1
D1
1
D6
1
D2
Inputs
Output
xOE
xCLK
xDx
xQx
L
↑
HH
L
↑
LL
LH or L
X
Q0
HX
X
Z
Pin Names
Description
xDx
Data Inputs
(1)
xCLK
Clock Inputs
xQx
3–State Outputs
xOE
3–State Output Enable Inputs (Active Low)
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PDF描述
IDT74ALVCH16835PA8 ALVC/VCX/A SERIES, 18-BIT DRIVER, TRUE OUTPUT, PDSO56
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