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参数资料
型号： IDT74ALVCH16821PV8
厂商： INTEGRATED DEVICE TECHNOLOGY INC
元件分类： 总线收发器
英文描述： ALVC/VCX/A SERIES, DUAL 10-BIT DRIVER, TRUE OUTPUT, PDSO56
封装： 0.635 MM PITCH, SSOP-56
文件页数： 4/6页
文件大小： 109K
代理商： IDT74ALVCH16821PV8
4
EXTENDED COMMERCIAL TEMPERATURE RANGE
IDT74ALVCH16821
3.3V CMOS 20-BIT BUS-INTERFACE FLIP-FLOP
SWITCHING CHARACTERISTICS (1)
NOTES:
1. See test circuits and waveforms. TA = – 40°C to + 85°C.
2. Skew between any two outputs of the same package and switching in the same direction.
OPERATING CHARACTERISTICS, TA = 25oC
OUTPUT DRIVE CHARACTERISTICS
NOTE:
1.
VIH and VIL must be within the min. or max. range shown in the DC ELECTRICAL CHARACTERISTICS OVER OPERATING RANGE table for the
appropriate VCC range. TA = – 40°C to + 85°C.
Symbol
Parameter
Test Conditions(1)
Min.
Max.
Unit
VOH
Output HIGH Voltage
VCC = 2.3V to 3.6V
IOH = – 0.1mA
VCC – 0.2
—
V
VCC = 2.3V
IOH = – 6mA
2
—
VCC = 2.3V
IOH = – 12mA
1.7
—
VCC = 2.7V
2.2
—
VCC = 3.0V
2.4
—
VCC = 3.0V
IOH = – 24mA
2
—
VOL
Output LOW Voltage
VCC = 2.3V to 3.6V
IOL = 0.1mA
—
0.2
V
VCC = 2.3V
IOL = 6mA
—
0.4
IOL = 12mA
—
0.7
VCC = 2.7V
IOL = 12mA
—
0.4
VCC = 3.0V
IOL = 24mA
—
0.55
NEW16link
VCC = 2.5V ± 0.2V
VCC = 3.3V ± 0.3V
Symbol
Parameter
Test Conditions
Typical
Unit
CPD
Power Dissipation Capacitance per flip-flop
Outputs enabled
CL = 0pF, f = 10Mhz
36
40
pF
CPD
Power Dissipation Capacitance per flip-flop
Outputs disabled
22
24
pF
VCC = 2.5V ± 0.2V
VCC = 2.7V
VCC = 3.3V ± 0.3V
Symbol
Parameter
Min.
Max.
Min.
Max.
Min.
Max.
Unit
fMAX
150
—
150
—
150
—
MHz
tPLH
tPHL
Propagation Delay
xCLK to xQx
15.8
—
5.3
1
4.5
ns
tPZH
tPZL
Output Enable Time
xOE to xQx
16.6
—
6.2
1
5.1
ns
tPHZ
tPLZ
Output Disable Time
xOE to xQx
15.7
—
51
4.6
ns
tW
Pulse Duration, xCLK HIGH or LOW
3.3
—
3.3
—
3.3
—
ns
tSU
Set-up Time, data before xCLK
↑
4.4
—
3.9
—
3.4
—
ns
tH
Hold Time, data after xCLK
↑
0—
ns
tSK(O)
Output Skew(2)
—————
500
ps
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PDF描述
IDT74ALVCH16835PA8 ALVC/VCX/A SERIES, 18-BIT DRIVER, TRUE OUTPUT, PDSO56
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