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参数资料
| 型号： | IDT74SSTU32865BKG |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 12/15页 |
| 文件大小： | 0K |
| 描述： | IC BUFFER 28BIT 1:2 REG 160TFBGA |
| 产品变化通告： | Product Discontinuation 09/Dec/2011 |
| 标准包装： | 119 |
| 逻辑类型： | 1:2 寄存缓冲器，带奇偶位 |
| 位数： | 28 |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 160-LFBGA |
| 供应商设备封装： | 160-CABGA（9x13） |
| 包装： | 托盘 |
| 其它名称： | 74SSTU32865BKG |
6
COMMERCIALTEMPERATURERANGE
IDT74SSTU32865
28-BIT 1:2 REGISTERED BUFFER WITH PARITY
PARITY AND STANDBY FUNCTION TABLE(1)
Inputs
Output
RESET
DCS0
DCS1
CLK
ΣΣΣΣΣ of Inputs = H (D0 - D21)
PARIN(2)
PYTERR(3)
HL
H
↑↓
Even
L
H
HL
H
↑↓
Odd
L
HL
H
↑↓
Even
H
L
HL
H
↑↓
Odd
H
HH
L
↑↓
Even
L
H
HH
L
↑↓
Odd
L
HH
L
↑↓
Even
H
L
HH
L
↑↓
Odd
H
HHH
↑↓
XX
PYTERR
0
(4)
H
X
L or H
X
PYTERR
0
(4)
L
XorFloating
H
NOTES:
1. H = HIGH Voltage Level
L = LOW Voltage Level
X = Don’t Care
↑ = LOW to HIGH
↓ = HIGH to LOW
2. PARIN arrives one clock cycle after the data to which it applies
3. This transition assumes PTYERR is HIGH at the crossing of CLK going HIGH and CLK going LOW. If PTYERR is LOW, it stays latched LOW for two clock cycles, or until
RESET is driven LOW.
4. Output level before the indicated steady-state conditions were established.
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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| IDT74SSTU32866BBFG8 | 功能描述:IC BUFFER 1.8V CONFIG 96-BGA RoHS:是 类别:集成电路 (IC) >> 逻辑 - 专用逻辑 系列:- 产品变化通告:Product Discontinuation 25/Apr/2012 标准包装:1,500 系列:74SSTV 逻辑类型:DDR 的寄存缓冲器 电源电压:2.3 V ~ 2.7 V 位数:14 工作温度:0°C ~ 70°C 安装类型:表面贴装 封装/外壳:48-TFSOP（0.240"，6.10mm 宽） 供应商设备封装:48-TSSOP 包装:带卷 (TR) |
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