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参数资料
| 型号： | IDT74SSTUBH32865ABKG |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 14/17页 |
| 文件大小： | 0K |
| 描述： | IC BUFFER 28BIT 1:2 REG 160-BGA |
| 产品变化通告： | Product Discontinuation 09/Dec/2011 |
| 标准包装： | 119 |
| 逻辑类型： | 1:2 寄存缓冲器，带奇偶位 |
| 电源电压： | 1.7 V ~ 1.9 V |
| 位数： | 28 |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 160-LFBGA |
| 供应商设备封装： | 160-CABGA（9x13） |
| 包装： | 托盘 |
| 其它名称： | 74SSTUBH32865ABKG |
IDT74SSTUBH32865A
28-BIT 1:2 REGISTERED BUFFER FOR DDR2
COMMERCIAL TEMPERATURE GRADE
28-BIT 1:2 REGISTERED BUFFER FOR DDR2
6
IDT74SSTUBH32865A
7103/10
Parity and Standby Function Table
Inputs1
Outputs
RESET
DCS0
DCS1
CLK
Σ of Inputs = H (D1 - D21)
PARIN2
PTYERR3
HL
X
↑↓
Even
L
H
HL
X
↑↓
Odd
L
HL
X
↑↓
Even
H
L
HL
X
↑↓
Odd
H
HX
L
↑↓
Even
L
H
HX
L
↑↓
Odd
L
HX
L
↑↓
Even
H
L
HX
L
↑↓
Odd
H
HH
H
↑↓
X
PTYERR0
H
X
L or H
X
PTYERR0
LX or
Floating
X or
Floating
X or
Floating
X or
Floating
X or Floating
H
1
H = HIGH Voltage Level
L = LOW Voltage Level
X = Don’t Care
↑ = LOW to HIGH
↓ = HIGH to LOW
2
PARIN arrives one clock cycle after the data to which it applies.
3
This transition assumes PTYERR is HIGH at the crossing of CLK going HIGH and CLK going LOW. If
PTYERR is LOW, it stays latched LOW for two clock cycles or until RESET is driven LOW.
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PDF描述 |
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| IDT74SSTUBF32865ABK | IC BUFFER 28BIT 1:2 REG 160-BGA |
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相关代理商/技术参数 |
参数描述 |
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| IDT74SSTUBH32868ABKG8 | 功能描述:IC BUFFER 28BIT CONF DDR2 176BGA RoHS:是 类别:集成电路 (IC) >> 逻辑 - 专用逻辑 系列:- 产品变化通告:Product Discontinuation 25/Apr/2012 标准包装:1,500 系列:74SSTV 逻辑类型:DDR 的寄存缓冲器 电源电压:2.3 V ~ 2.7 V 位数:14 工作温度:0°C ~ 70°C 安装类型:表面贴装 封装/外壳:48-TFSOP（0.240"，6.10mm 宽） 供应商设备封装:48-TSSOP 包装:带卷 (TR) |
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