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参数资料
| 型号： | IDT821024PPG |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 3/13页 |
| 文件大小： | 0K |
| 描述： | IC PCM CODEC QUAD NONPROG 44TQFP |
| 标准包装： | 80 |
| 类型： | PCM 编解码器/滤波器 |
| 数据接口： | PCM 音频接口 |
| ADC / DAC 数量： | 4 / 4 |
| 三角积分调变： | 无 |
| 电压 - 电源，模拟： | 4.75 V ~ 5.25 V |
| 电压 - 电源，数字： | 4.75 V ~ 5.25 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 44-LQFP |
| 供应商设备封装： | 44-TQFP |
| 包装： | 托盘 |
| 其它名称： | 800-2624 821024PPG IDT821024PPG-ND |
11
INDUSTRIAL TEMPERATURE RANGE
IDT821024 QUAD NON-PROGRAMMABLE PCM CODEC
TIMING CHARACTERISTICS
Clock
Parameter
Description
Min
Typ
Max
Units
Test Conditions
t1
PCLK Duty Cycle
40
60
%
PCLK=512kHz to 8.192MHz
t2
PCLK Rise and Fall Time
25
ns
PCLK=512kHz to 8.192MHz
t3
MCLK Duty Cycle
40
60
%
MCLK=2.048Hz,4.096MHz
or 8.192MHz
t4
MCLK Rise and Fall Time
15
ns
MCLK=2.048Hz,4.096MHz
or 8.192MHz
t5
PCLK Clock Period
244
ns
PCLK=512kHz to 8.192MHz
Transmit
Parameter
Description
Min
Typ
Max
Units
Test Conditions
t11
Data Output Delay Time (for Short
Frame Sync Mode)
5
70
ns
t12
Data Hold Time
5
70
ns
t13
Data Delay to High-Z
50
220
t5+70
ns
t14
Frame sync Hold Time
50
ns
t15
Frame sync High Setup Time
55
t5-50
ns
t16
TSC Enable Delay Time(for Short
Frame Sync Mode)
5
80
ns
t17
TSC Disable Delay Time
50
220
t5+70
ns
t18
Data Output Delay Time(for Long
Frame Sync Mode)
5
40
ns
t19
TSC Enable Delay Time(for Long
Frame Sync Mode)
5
40
ns
t21
Receive Data Setup Time
25
ns
t22
Receive Data Hold Time
5
ns
Figure 2. MCLK Timing
Note: Timing parameter t13 is referenced to a high-impedance state.
MCLK
t4
相关PDF资料 |
PDF描述 |
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