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参数资料
| 型号： | IDT85304-01 |
| 厂商： | Integrated Device Technology, Inc. |
| 英文描述： | LOW SKEW, 1-TO-5 DIFFERENTIAL-TO-3.3V LVPECL FANOUT BUFFER |
| 中文描述： | 低偏移，1至5差分至3.3伏的LVPECL扇出缓冲器 |
| 文件页数： | 2/11页 |
| 文件大小： | 77K |
| 代理商： | IDT85304-01 |
2
COMMERCIAL AND INDUSTRIAL TEMPERATURE RANGES
IDT85304-01
LOW SKEW, 1-TO-5 DIFFERENTIAL-TO-3.3V LVPECL
PIN CONFIGURATION
NOTE:
1. Stresses beyond those listed under ABSOLUTE MAXIMUM RATINGS may cause
permanent damage to the device. These are stress ratings only, and functional
operation of the device at these or any other conditions above those indicated in the
operational sections of this specification is not implied. Exposure to absolute-
maximum-rated conditions for extended periods may affect device reliability.
ABSOLUTE MAX IMUM RATINGS
(1)
Symbol
Description
V
DD
Power Supply Voltage
V
I
Input Voltage
V
O
Output Voltage
θ
JA
Package Thermal Impedance (0 lfpm
T
STG
Storage Temperature
Max
4.6
Unit
V
V
V
°C/W
–0.5 to V
DD
+0.5
–0.5 to V
DD
+0.5
92.6
–65 to +150
°C
CAPACITANCE
(T
A
= +25°C, f = 1MHz, V
IN
= 0V)
Parameter
Description
C
IN
Input Capacitance
R
PULLUP
Input Pullup Resistor
R
PULLDOWN
Input Pulldown Resistor
Typ.
—
51
51
Max.
4
—
—
Unit
pF
K
K
TSSOP
TOP VIEW
1
2
3
4
5
6
7
8
9
10
20
19
18
17
16
15
14
13
12
11
Q0
xQ0
Q1
xQ1
Q2
xQ2
Q3
xQ3
Q4
xQ4
V
DD
CLK_EN
V
DD
xPCLK
PCLK
V
EE
xCLK
CLK
CLK_SEL
V
DD
PIN DESCRIPTION
(1)
Symbol
xQ0, Q0
xQ1, Q1
xQ2, Q2
xQ3, Q3
xQ4, Q4
V
DD
CLK_SEL
Number
1, 2
3, 4
5, 6
7, 8
9, 10
11, 18, 20
12
Type
Description
Output
Output
Output
Output
Output
Power
Input
Differential Output Pair. LVPECL interface levels.
Differential Output Pair. LVPECL interface levels.
Differential Output Pair. LVPECL interface levels.
Differential Output Pair. LVPECL interface levels.
Differential Output Pair. LVPECL interface levels.
Positive Supply Pins
Clock Select Input. When HIGH, selects PCLK / xPCLK inputs. When LOW, selects
CLK / xCLK inputs. LVTTL / LVCMOS interface levels.
Non-Inverting Differential Clock Input
Inverting Differential Clock Input
Negative Supply Pin
Non-Inverting Differential LVPECL Clock Input
Inverting Differential LVPECL Clock Input
Synchronizing Clock Enable. When HIGH, clock outputs follow clock input. When
LOW, Q outputs are forced LOW, xQ outputs are forced HIGH. LVTTL / LVCMOS
interface levels.
Pulldown
CLK
xCLK
V
EE
PCLK
xPCLK
CLK_EN
13
14
15
16
17
19
Input
Input
Power
Input
Input
Input
Pulldown
Pullup
Pulldown
Pullup
Pullup
NOTE:
1. Pullup and Pulldown refer to internal input resistors. See Capacitance table for typical values.
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