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参数资料
| 型号： | IP-PCI/MT32 |
| 厂商： | Altera |
| 文件页数： | 112/360页 |
| 文件大小： | 0K |
| 描述： | IP PCI 32BIT MASTER/TARGET |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | PCI 编译器，主控/目标，32 位 |
| 许可证： | 初始许可证 |
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Configuration Registers
Table 3–23 shows the format of memory BARs.
Table 3–23. Memory BAR Format
0
Data
Bit
Mnemonic
mem_ind
Read/Write
Read
Definition
Memory indicator. The mem_ind bit indicates that the register maps into
memory address space. This bit must be set to 0 in the BAR n parameter.
2..1
mem_type
Read
Memory type. The mem_type bits indicate the type of memory that can
be implemented in the function’s memory address space. Only the
following two possible values are valid for the PCI MegaCore functions:
locate memory space in the 32-bit address space and locate memory
space in the 64-bit address space.
3
pre_fetch
Read
Memory prefetchable. The pre_fetch bit indicates whether the blocks
of memory are prefetchable by the host bridge.
31..4
bar
Read/write
Base address registers.
In addition to the type of space reserved by the BAR, the wizard allows
you to define the size of address space reserved for each individual BAR
and sets the BAR n parameter value accordingly. The value for parameter
BAR n defines the number of read/write bits instantiated in the
corresponding BAR (Refer to Section 6.2.5 of the PCI Local Bus
Specification, Revision 3.0 ). The number of read/write bits instantiated in a
BAR is indicated by the number of 1s in the corresponding BAR n value
starting from bit 31. The BAR n parameter should contain 1 s from bit 31
down to the required bit without any 0 s in between (e.g., 0xFF000000 is
legal, but 0xFF700000 is not). The wizard does not offer options that set
the BARn parameters to illegal values.
For high-end systems that require more than 4 GBytes of memory space,
the pci_mt64 and pci_t64 functions support 64-bit addressing. These
functions offer the option to use either BARs 1 and 0 or BARs 2 and 1 to
implement a 64-bit BAR.
When implementing a 64-bit BAR, the least significant BAR contains the
lower 32-bit BAR and the most significant BAR contains the upper 32-bit
BAR. When implementing a 64-bit BAR, the wizard allows the option of
which BARs to use and sets the BAR n parameters accordingly. On the
least significant BAR, bits [31..4] are read/write registers that are used
to indicate the size of the memory, along with the most significant BAR.
For the most significant BAR, the wizard allows you to choose the
maximum number of read/write registers to implement per the
application.
3–38
PCI Compiler
User Guide Version 11.1
Altera Corporation
October 2011
相关PDF资料 |
PDF描述 |
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