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参数资料
型号： IPTR-DSPBUILDER
厂商： Altera
文件页数： 396/404页
文件大小： 0K
描述： DSP BUILDER SOFTWARE
标准包装： 1
类型： DSP
功能： DSP 构造器
许可证： 续用许可证
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Index–2
Using advanced PLL features 3–15
Using Clock and Clock_Derived blocks 3–10
Comments
Adding to a block 3–24
Comparator block 15–5
Complex AddSub block 16–3
Complex Conjugate block 16–5
Complex Constant block 16–7
Complex Delay block 16–8
Complex Multiplexer block 16–10
Complex Product block 16–11
Complex to Real-Imag block 16–13
Complex Type library 16–1
Constant block 19–11
Controlling synthesis and compilation 3–19
Counter block 15–6
Custom library
Adding to the library browser 9–5
Creating a library model file 9–1
Walkthrough 9–1
Cyclone III EP3C120 DSP board 24–2
Cyclone III EP3C25 DSP board 24–1
D
Data width propagation 3–4
Decoder block 17–7
Delay block 22–1
Demultiplexer block 17–8
Design flow 2–1
Control using Signal Compiler 3–19
Overview 2–1
Using a State Machine Editor block 11–7
Using a State Machine Table Block 11–2
Using Hardware in the loop 5–1
Using MegaCore functions 4–2
Design rules 3–1
Bit width 3–4
Frequency 3–8
Signal Compiler 3–19
Device family support
Standard blockset 1–1
Differentiator block 15–8
Digital signal processing (DSP) 1–2
Display Pipeline Depth block 14–4
Divider block 15–9
Down Sampling block 22–3
DSP block 15–10
DSP development board
Board description file 10–3
Component description file 10–2
Creating a board library 10–6
Creating a new board description 10–1
predefined components 10–1
Supported boards 10–1
DSP Builder Handbook
Volume 2: DSP Builder Standard Blockset
Troubleshooting 13–5
Dual-Clock FIFO block 22–4
Dual-Port RAM block 22–6
E
Error message
Data type mismatch 13–6
Design includes pre-v7.1 blocks 13–6
Loop while propagating bit widths 13–4
Output connected to Altera block 13–5
Unexpected end of file 13–10
When generating blocks 13–7
Example designs
32 tap FIR filter 26–7
Amplitude modulation 26–3
Avalon-MM Blocks 26–4
Avalon-MM FIFO 26–4
CIC decimation 26–6
CIC interpolation 26–6
Color space converter 26–7
Combined blocksets 26–11
Convolution interleaver deinterleaver 26–6
CORDIC, 20 bits rotation mode 26–8
Custom Library 26–5
Custom library block 9–1
Cyclone III EP3C120 board (7-seg display)
26–10
Cyclone III EP3C120 board (HSMC A) 26–10
Cyclone III EP3C120 board (HSMC B) 26–10
Cyclone III EP3C120 board (LED/PB) 26–9
Cyclone III EP3C25 starter board 26–9
Farrow based resampler 26–8
Getting started tutorial 2–4
Hardware in the loop 5–2
HDL Import 26–5
HDL import 8–1
HIL frequency sweep 26–3
IIR filter 26–6
Imaging edge detection 26–8
MAC based 32 tap FIR filter 26–7
Quartus II assignment setting 26–9
SignalTap II 6–3
SignalTap II filtering lab 26–9
SignalTap II filtering lab with loopback 26–9
SOPC Builder peripheral 7–8
State machine example 11–1
State Machine Table 26–5
Stratix III EP3SL150 board (7-seg display) 26–11
Stratix III EP3SL150 board (HSMC A) 26–11
Stratix III EP3SL150 board (HSMC B) 26–11
Stratix III EP3SL150 board (LED/PB) 26–10
Subsystem Builder 26–5
Switch Control 26–4
External RAM block 21–1
November 2013 Altera Corporation
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PDF描述
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