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参数资料
| 型号： | IR3093MTRPBF |
| 厂商： | International Rectifier |
| 文件页数： | 11/39页 |
| 文件大小： | 0K |
| 描述： | IC CTLR 3PHASE VR10 48-MLQP |
| 标准包装： | 3,000 |
| 应用： | VID 电压编程器 |
| 电源电压： | 7.4 V ~ 21 V |
| 电流 - 电源： | 38mA |
| 工作温度： | 0°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 48-MLPQ |
| 供应商设备封装： | 48-MLPQ（7x7） |
| 包装： | 带卷 (TR) |
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IR3093PbF
PWM Operation
The IR3093 is a fully integrated 3 phase interleaved PWM control IC which uses voltage mode control with trailing
edge modulation. A high-gain wide-bandwidth voltage type Error Amplifier in the Control IC is used for the voltage
control loop. The PWM block diagram is shown in Figure 2.
U30
IROSC
CLK1
CLK2
CLK2
PWM COMPARATOR
RSFF
S
Q
OSCBLOCK
CLK3
CLK3
-
+
QB
R
RESET DOMINANT
VIN
OVPSNS
IROSC/2
GATEH1
CDAC
RDAC
VDAC
VDAC
80mV
BB DISABLE
ERROR AMPLIFIER
9p
0.6V
GATEL1
1
RCS1
2
CCS1
VOSNS-
CCOMP
FB
IROSC
0.47V
0% DUTY CYCLE
CLK2
PWM COMPARATOR
RSFF
S
Q
GATEH2
VIN
VOUT SENSE+
RCOMP
EAOUT
-
+
QB
R
RESET DOMINANT
GATEL2
1
2
VOUT+
COUT
RDRP
VDRP
VDRP BUFFER
Share Adjust Error Amp
IROSC
RCS2
CCS2
VOUT-
VOUT SENSE-
RFB
+
-
0 TO IROSC*3/4
9p
0.6V
SCOMP2
CSC2
RSC2
PWM COMPARATOR
EAOUT
-
+
CLK3
RSFF
S
Q
QB
R
RESET DOMINANT
GATEH3
GATEL3
VIN
1
2
Share Adjust Error Amp
IROSC
RCS3
CCS3
+
-
0 TO IROSC*3/4
9p
0.6V
SCOMP3
VDAC
CSC3
RSC3
VDAC
X23.5
X23.5
-
+
-
CSINM3
CSINP3
CSINM2
CSINP2
+
VDAC
X23.5
-
CSINM1
CSINP1
+
Figure 2 – PWM Block Diagram
Refer to Figure 3. Upon receiving a clock pulse, the RSFF is set, the internal PWM ramp voltage begins to increase,
the low side driver is turned off, and the high side driver is then turned on. For phase 1, an internal 9pf capacitor is
charged by a current source that proportional to the switching frequency resulting in a ramp rate of 50mV per percent
duty cycle. For example, if the steady-state operating switch node duty cycle is 10%, then the internal ramp amplitude
is typically 500mV from the starting point (or floor) to the crossing of the EAOUT control voltage. When the PWM
ramp voltage exceeds the Error Amplifier’s output voltage, the RSFF is reset. This turns off the high side driver, turns
on the low side driver, and discharges the PWM ramp to 0.6V until the next clock pulse.
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09/08/05
相关PDF资料 |
PDF描述 |
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