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参数资料
| 型号： | IRDCIP1201-A |
| 厂商： | International Rectifier |
| 文件页数： | 10/29页 |
| 文件大小： | 0K |
| 描述： | BUCK CONV REF DESIGN KIT IP1201 |
| 标准包装： | 1 |
| 系列： | iPOWIR™ |
| 主要目的： | DC/DC，步降 |
| 输出及类型： | 2，非隔离 |
| 输出电压： | 1.5V，2.5V |
| 电流 - 输出： | 15A，15A |
| 输入电压： | 3.14 ~ 5.5 V |
| 稳压器拓扑结构： | 降压 |
| 频率 - 开关： | 300kHz |
| 板类型： | 完全填充 |
| 已供物品： | 板 |
| 已用 IC / 零件： | iP1201 |
| 相关产品： | IP1201TRPBF-ND - IC REG BUCK SYNC ADJ 30A 198BGA IP1201PBF-ND - IC REG BUCK SYNC ADJ 30A 198BGA IP1201TR-ND - IC REG BUCK SYNC ADJ 30A 198BGA IP1201-ND - IC REG BUCK SYNC ADJ 30A 198BGA |
| 其它名称： | *IRDCIP1201-A |
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iP1201
Pin Name
V IN
Ball Designator
A1 A2 A3 A4 A5 A14 A15 A16 A17 A18 B1 B2 B3 B4 B5
B14 B15 B16 B17 B18 C1 C2 C3 C4 C5 C14 C15 C16
Pin Description
Input voltage connection node
C17 C18
Internally generated voltage. Connect to pin B when Vin < 3.5V.
A*
B*
CC1
CC2
ENABLE
SS1
SS2
FB1
FB1s
FB2
FB2s
VSW1
VSW2
PGND
Vref
VP-ref
SYNC
R T
PGOOD
HICCUP
NC
G8 J13
L12 L13
H8
H13
A8 B8
H6
G11
J6
J8
H11
J11
D1 D2 D3 E1 E2 F1 F2 G1 G2 G3 H1 H2 H3 J1 J2 J3 K1
K2 L1 L2
D16 D17 D18 E17 E18 F17 F18 G16 G17 G18 H16 H17
H18 J16 J17 J18 K17 K18 L17 L18
A6 A7 A9 A10 A12 A13 B6 B7 B9 B10 B12 B13 C6 C7 C9
C10 C12 C13 D6 D7 D9 D10 D12 D13 D14 E3 E4 E8 E11
E15 E16 F3 F4 F5 F6 F9 F10 F13 F14 F15 F16 G4 G5 G6
G9 G10 G13 G14 G15 H4 H5 H9 H10 H14 H15 J4 J5 J9
J10 J14 J15 K3 K16 L3 L5 L14 L16
L9
L8
K6
K13
L10
L6 L7
L11
Leave floating for input voltages >3.5V. Externally, add a 2.2μF
capacitor
Internally generated voltage. Connect to pin A when Vin < 3.5V.
Leave floating for input voltages >3.5V. Externally, add a 2.2μF
capacitor
Output of the first error amplifier, refer to Fig.1 block diagram
Output of the second error amplifier
Single pin for both outputs. Commands outputs ON or OFF. Pulled
low, turns both outputs ON. Should be pulled high to disable outputs.
Soft start pin for output1. External capacitor
provides soft start. Pulled low disables output 1.
Soft start pin for output2. External capacitor
provides soft start. Pulled low disables output 2.
Inverting input of error amplifier 1
Output 1 voltage sense pin
Inverting input of error amplifier 2
Output 2 voltage sense pin
Output 1 inductor connection node
Output 2 inductor connection node
Power Ground
Amplifier 1 reference Voltage. Connect a 100pf cap from this pin to
PGND.
Amplifier 2 reference voltage. Connect to Vref for independent
output configuration. Refer to function description section on how to
connect for parallel configuration.
External Clock synchronization pin. Set free running frequency to
80% of the SYNC frequency. When not in use leave pin floating.
Switching frequency setting pin. For R T selection, refer to Fig.11 R T
vs Frequency curve.
Power Good pin, needs external pull-up resistor. If not used pin can
be left floating.
Logic level pin. Pulled high enables hiccup mode of operation. Pulled
low enables overcurrent shutdown mode.
Unused pin. No electrical connection.
* Part will malfunction if pins A and B are shorted together for input voltages >3.5V
Table 1: Pin Description
10
www.irf.com
相关PDF资料 |
PDF描述 |
|---|---|
| R1S-153.3 | CONV DC/DC 1W 15VIN 3.3VOUT |
| IRDCIP1001-A | CONV SGL PHA SYNC BUCK 3.3-4.5V |
| R1S-1524 | CONV DC/DC 1W 15VIN 24VOUT |
| R1S-1515 | CONV DC/DC 1W 15VIN 15VOUT |
| ADP1873-BL1-EVZ | EVAL BOARD FOR ADP1873 |
相关代理商/技术参数 |
参数描述 |
|---|---|
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| IRDCIP2001-A | 功能描述:IC CONVRTR 2PH BUCK 40A W/IP2001 RoHS:否 类别:编程器，开发系统 >> 过时/停产零件编号 系列:iPOWIR™ 标准包装:1 系列:- 类型:MCU 适用于相关产品:Freescale MC68HC908LJ/LK（80-QFP ZIF 插口） 所含物品:面板、缆线、软件、数据表和用户手册 其它名称:520-1035 |
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