参数资料
型号: ISL6146AFRZ
厂商: Intersil
文件页数: 2/28页
文件大小: 0K
描述: IC INTERFACE
标准包装: 100
系列: *
ISL6146
Block Diagram
BIAS
Q-PUMP
FAULT DIAGNOSTIC
1. V IN - V OUT > 570mV
VIN
+
VDS FORWARD
REGULATOR
GATE
2. GATE - V IN < 220mV (A,B,C only)
3. TEMP > +150°C
4. V BIAS < POR (ISL6146A/B/D/E)
5. V IN OR V OUT < POR (ISL6146C)
FLT
19mV
6. V IN < V OUT
VOUT
REVERSE DETECTION
7. Gate to Drain and Gate to Source Shorts
57mV COMPARATOR
+
UVLO
+
8mA
EN/EN
ENABLE
ADJ
ENABLE
+
*
HIGH SPEED
4A
+
-
V REF
OVP
+
EN
COMPARATOR
* Connected to BIAS on ISL6146A/B/D/E
ISL6146A/B/D/E
+
-
V REF
Connected to VOUT on ISL6146C
ISL6146C
Pin Configuration
ISL6146
(8 LD MSOP/DFN)
ISL6146A, ISL6146B, ISL6146D, ISL6146E
TOP VIEW
ISL6146C
GATE
VIN
BIAS
EN ISL6146A/D
EN ISL6146B/E
1
2
3
4
8
7
6
5
VOUT
ADJ
FAULT
GND
GATE
VIN
UVLO
OVP
1
2
3
4
8
7
6
5
VOUT
ADJ
FAULT
GND
EPAD o n DFN only, connect to GND
Pin Descriptions
MSOP/
DFN
1
2
3
ISL6146A
ISL6146B
ISL6146D
ISL6146E
3
ISL6146C
4
ISL6146A
ISL6146D
SYMBOL
GATE
VIN
BIAS
UVLO
EN
DESCRIPTION
Gate Drive output to the external N-Channel MOSFET generated by the IC internal charge pump. Gate turn-on time is typically
<1ms. Allows active control of external N-Channel FET gate to perform OR-ing function.
The GATE drive is between V IN + 7V at V IN = 3.3V and V IN +12V at V IN = 18V.
Connected to the sourcing supply side (OR-ing MOSFET Source), this pin serves as the sense pin to determine the OR’d
supply voltage. The OR-ing MOSFET will be turned off when V IN becomes lower than V OUT by a value more than the externally
set threshold or the defaulted internal threshold. Range: 0V to 24V
Primary bias pin. Connected to an independent voltage supply greater than or equal to 3V and greater than V IN .
Range: 3.0 to 24V
Programmable UVLO protection to prevent premature turn-on prior to VIN being adequately biased. Range: 0V to 24V
Active high enable input to turn on the FET. Internally pulled low to GND through 2M ? .
Range: 0V to 24V
2
FN7667.4
April 26, 2013
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