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参数资料
| 型号： | ISL6271AEVAL1 |
| 厂商： | Intersil |
| 文件页数： | 5/13页 |
| 文件大小： | 0K |
| 描述： | EVALUATION BOARD FOR ISL6271A |
| 标准包装： | 1 |
| 主要目的： | DC/DC，LDO 步降 |
| 输出及类型： | 3，非隔离 |
| 输出电压： | 0.85 ~ 1.6V，1.1V，1.3V |
| 电流 - 输出： | 800mA，50mA，40mA |
| 输入电压： | 2.76 ~ 5.5V |
| 稳压器拓扑结构： | 降压 |
| 频率 - 开关： | 1.2MHz |
| 板类型： | 完全填充 |
| 已供物品： | 板，线缆 |
| 已用 IC / 零件： | ISL6271A |
Setup Instructions for the ISL6271A Evaluation Kit
Connect J3 on evaluation board to the electronic load, ( Figure 7 ), observing proper polarities.
T
O
L
O
A
D
FIGURE 7.
CONNECT THE J3 ON THE EVALUATION BOARD TO THE ELECTRONIC LOAD
NOTE: (Fixed resistive loads of 1Kohm each are connected across the VPLL and VSRAM outputs onboard. If variable loading is
desired, such a load can be connected via J4)
Reapply power and observe DVM#2 indicating 1.3V and that the load is sinking 200mA.
Basic functionality is confirmed and thorough testing/characterization can begin.
TP5 and TP2 will accommodate low-noise Tek scope probe tips for monitoring the AC characteristics of Vcore and
Phase, respectively.
The phase node is a good signal point from which to trigger and observe cycle-by-cycle switching behavior of the
V core regulator. Connect the trigger channel to the TP2 probe point to trigger on the phase signal. See Figure 8 for a
typical scope shot of the Vcore voltage(AC) when triggered from the phase node.
V core
Phase
5
FIGURE 8.
V CORE AND PHASE
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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