参数资料
| 型号： | ISL6324AIRZ-T |
| 厂商： | Intersil |
| 文件页数： | 10/40页 |
| 文件大小： | 0K |
| 描述： | IC HYBRID CTRLR PWM DUAL 48QFN |
| 标准包装： | 4,000 |
| 应用： | 控制器，AMD SVI |
| 输入电压： | 5 V ~ 12 V |
| 输出数： | 2 |
| 输出电压： | 最高 2V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 48-VFQFN 裸露焊盘 |
| 供应商设备封装： | 48-QFN（7x7） |
| 包装： | 带卷 (TR) |
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ISL6324A
Electrical Specifications
Recommended Operating Conditions (0°C to +70°C), Unless Otherwise Specified.
MIN
MAX
PARAMETER
TEST CONDITIONS
(Note 4)
TYP
(Note 4)
UNITS
REFERENCE AND DAC
System Accuracy (VDAC > 1.000V)
System Accuracy (0.600V < VDAC < 1.000V)
System Accuracy (VDAC < 0.600V)
DVC Voltage Gain
VDAC = 1V
-0.6
-1.0
-2.0
2.0
0.6
1.0
2.0
%
%
%
V
APA Current Tolerance
V APA = 1V
90
100
108
μA
ERROR AMPLIFIER
DC Gain
Gain-Bandwidth Product (Note 3)
Slew Rate (Note 3)
R L = 10k to ground, (Note 3)
C L = 100pF, R L = 10k to ground, (Note 3)
C L = 100pF, Load = ±400μA, (Note 3)
96
20
8
dB
MHz
V/μs
Maximum Output Voltage
Load = 1mA
3.80
4.20
V
Minimum Output Voltage
Load = -1mA
1.3
1.6
V
SOFT-START RAMP
Soft-Start Ramp Rate
2.2
3.0
4.0
mV/μs
PWM OUTPUTS
PWM Output Voltage LOW Threshold
PWM Output Voltage HIGH Threshold
I LOAD = ±500μA
I LOAD = ±500μA
4.5
0.5
V
V
CURRENT SENSING - CORE CONTROLLER
Sensed Current Tolerance
V ISENn- - V ISENn+ = 23.2mV, R SET = 37.6k Ω ,
68
88
μA
4 Phases, T A = +25°C
CURRENT SENSING - NB CONTROLLER
Sensed Current Tolerance
V ISEN_NB- - V ISEN_NB+ = 23.2mV,
R SET = 37.6k Ω , 4 Phases, T A = +25°C
68
89
μA
DROOP CURRENT
Tolerance
V ISENn- - V ISENn+ = 23.2mV, R SET = 37.6k Ω ,
68
88
μA
4 Phases, T A = +25°C
OVERCURRENT PROTECTION
Overcurrent Trip Level - Average Channel
Normal Operation, R SET = 28.2k Ω
87
100
120
μA
Dynamic VID Change (Note 3)
130
μA
Overcurrent Limiting- Individual Channel
Normal Operation, R SET = 28.2k Ω
Dynamic VID Change (Note 3)
142
190
μA
μA
POWER-GOOD
Core Overvoltage Threshold
Undervoltage Threshold
VSEN Rising
Bit 6 of I 2 C data = 0
VSEN Falling (Core)
Bit 6 of I 2 C data = 0
ISEN_NB+ Falling (North Bridge)
Bit 6 of I 2 C data = 0
VDAC +
225mV
VDAC -
325mV
VDAC -
310mV
VDAC +
250mV
VDAC -
300mV
VDAC -
275mV
VDAC +
275mV
VDAC -
270mV
VDAC -
235mV
V
mV
mV
Power Good Hysteresis
OVERVOLTAGE PROTECTION
50
mV
OVP Trip Level
OVP Lower Gate Release Threshold
Bit 7 of I 2 C data = 0, VDAC ≤ 1.55V
1.73
350
1.80
400
1.84
V
mV
UGATE Rise Time
LGATE Rise Time
10
t RUGATE; V PVCC = 12V, 3nF Load, 10% to 90%
t RLGATE; V PVCC = 12V, 3nF Load, 10% to 90%
26
18
ns
ns
FN6880.2
May 14, 2010
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