参数资料
| 型号： | ISL6536IB |
| 厂商： | Intersil |
| 文件页数： | 3/7页 |
| 文件大小： | 0K |
| 描述： | IC SUPERVISOR 4-CHAN 8-SOIC |
| 标准包装： | 98 |
| 类型： | 多压监控器 |
| 监视电压数目： | 4 |
| 输出： | 开路漏极或开路集电极 |
| 复位： | 低有效 |
| 电压 - 阀值： | 可调节/可选择 |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 8-SOIC（0.154"，3.90mm 宽） |
| 供应商设备封装： | 8-SOIC |
| 包装： | 管件 |
ISL6536
Absolute Maximum Ratings
VDD . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . +5.5V
VMON, PGOOD, ENABLE. . . . . . . . . . . . . . . . . -0.3V to VDD+0.3V
ESD Classification . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4kV (HBM)
Operating Conditions
VDD Supply Voltage Range. . . . . . . . . . . . . . . . . . . . . +2.7V to +4V
Thermal Information
Thermal Resistance (Typical, Note 1) θ JA ( ° C/W)
8 Ld SOIC . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 108
Maximum Junction Temperature . . . . . . . . . . . . . . . . . . . . . . . 150 ° C
Maximum Storage Temperature Range . . . . . . . . . . . -65 ° C to 150 ° C
Pb-Free Reflow Profile. . . . . . . . . . . . . . . . . . . . . . . . .see link below
http://www.intersil.com/pbfree/Pb-FreeReflow.asp
Temperature Range (T A ) . . . . . . . . . . . . . . . . . . . . . . .-40 ° C to 85 ° C
CAUTION: Do not operate at or near the maximum ratings listed for extended periods of time. Exposure to such conditions may adversely impact product reliability and
result in failures not covered by warranty.
NOTES:
1. θ JA is measured in free air with the component mounted on a high effective thermal conductivity test board. See Tech Brief TB379 for details.
2. All voltages are relative to GND, unless otherwise specified.
Electrical Specifications
Nominal VDD = 3.3V, T A = T J = -40 ° C - 85 ° C, Unless Otherwise Specified.
MIN
MAX
PARAMETER
SYMBOL
TEST CONDITIONS
(Note 3)
TYP
(Note 3)
UNIT
BIAS
IC Supply Current
VDD Power On
VDD Power On Reset
I VDD
VDD_L2H
VDD_POR
VMON > VMON _L2H
VDD low to high
VDD high to low
165
2.6
2.4
1000
μA
V
V
PGOOD
Pull-Down Current
Pull-Up Resistance
PG pd
PG pu
VPGOOD = 0.5V
2
20
mA
k Ω
Output Low
Delay from VMON Rising
Delay from EN Rising
Delay from EN Falling
V PGl
t PG delVMON
t PG delENR
t PG delENF
V DD = 1V
Last valid input = Vth to PG release
EN high to PG release
EN low to PG pulling low
0.05
2
0.05
0.015
0.1
V
μs
μs
μs
ENABLE
Rising Threshold
V EN
ENABLE Low to High Threshold
0.4VDD
0.5VDD
0.6VDD
V
Threshold Hysteresis
V EN_HYS
0.065
V
Pull-up Current
I ENpu
VEN = 0.5V
10
μA
VMON Input
Falling Threshold
3.3VMON _H2L
T J = +25°C
0.623
0.633
0.643
V
Falling Threshold Temp Coeff.
3.3VMON _TC
100
uV/ ° C
Hysteresis
Range
VVMON _HYS
VMON _RNG
-
-
10
8
-
-
mV
mV
Glitch Filter Duration
TFIL
VMON glitch to PGOOD low Filter
-
30
-
μs
NOTE:
3. Compliance to datasheet limits is assured by one or more methods: production test, characterization and/or design.
3
FN9114.3
January 25, 2011
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