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参数资料
| 型号： | ISL6744EVAL1 |
| 厂商： | Intersil |
| 文件页数： | 14/18页 |
| 文件大小： | 0K |
| 描述： | EVALUATION BOARD ISL6744 |
| 标准包装： | 1 |
| 主要目的： | DC/DC，步降 |
| 输出及类型： | 1，隔离 |
| 功率 - 输出： | 100W |
| 输出电压： | 12V |
| 电流 - 输出： | 8A |
| 输入电压： | 43.2 ~ 52.8V |
| 稳压器拓扑结构： | 降压 |
| 频率 - 开关： | 235kHz |
| 板类型： | 完全填充 |
| 已供物品： | 板 |
| 已用 IC / 零件： | ISL6744 |
ISL6744
13.5
13
12.5
12
11.5
11
10.5
42
43
44
45
46
47
48
49
50
51
52
53
INPUT VOLTAGE (V)
FIGURE 12. LINE REGULATION AT I OUT = 1A
Waveforms
FIGURE 14. FET DRAIN-SOURCE VOLTAGE
Typical waveforms can be found in the following Figures.
Figure 13 shows the output voltage ripple and noise at a 5A.
FIGURE 15. FET D-S VOLTAGE NEAR-ZVS TRANSITION
FIGURE 13. OUTPUT RIPPLE AND NOISE - 20MHz BW
Figures 14 and 15 show the voltage waveforms at the
switching node shared by the upper FET source and the
lower FET drain. In particular, Figure 15 shows near ZVS
operation at 5A of load when the upper FET is turning off
and the lower FET is turning on. ZVS operation occurs
completely, implying that all the energy stored in the node
capacitance has been recovered. Figure 16 shows the
switching transition between outputs, OUTA and OUTB
during steady state operation. The deadtime duration of
46.9ns is clearly shown.
A 2.7V zener is added between the Vdd pins of ISL6700 and
ISL6744, in order to ensure that the PWM turns on only after
the driver has turned on, thereby ensuring the soft-start
function. Figure 17 shows the soft-start operation.
FIGURE 16. OUTA - OUTB TRANSITION
14
FN9147.8
September 22, 2005
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PDF描述 |
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