参数资料
| 型号： | ISL97701IRZ |
| 厂商： | Intersil |
| 文件页数： | 8/10页 |
| 文件大小： | 0K |
| 描述： | IC REG BOOST ADJ 0.1A 10DFN |
| 标准包装： | 100 |
| 类型： | 升压（升压） |
| 输出类型： | 可调式 |
| 输出数： | 1 |
| 输出电压： | 可调 |
| 输入电压： | 2.3 V ~ 5.5 V |
| 频率 - 开关： | 1MHz |
| 电流 - 输出： | 100mA |
| 同步整流器： | 无 |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 10-VFDFN 裸露焊盘 |
| 包装： | 管件 |
| 供应商设备封装： | 10-DFN（3x3） |
ISL97701
sequence or in some cases disable the ISL97701 boost
function as long as the fault is present.
TABLE 1. FAULT PROTECTION
pin is, for example, static high, the internal oscillator defines
the LX output frequency and phase. When externally
synchronized, all falling edges at LX are timed from the
FAULT
DESCRIPTION
Undervoltage at
VDD
Overcurrent
FAULT
CONDITION
V(V DD ) <
V(V DD )off
I(VDD OUT ) >
ISL97701 FAULT REACTION
Disables I/Os and waits until
V(V DD ) reaches V(V DD )on to
begin with the start-up sequence
Disables VDD OUT switch and
falling edge of the clock signal applied at NSYNC. The timing
of the rising edge at LX is defined by the boost controller.
V(NSYNC)
drawn from
VDD OUT
It(VDD OUT )err LX driver and immediately
restarts the start-up sequence
Overvoltage at
V(V OUT ) >
Disables VDD OUT switch and
V OUT
Vt(V OUT )err
LX driver and waits until output
voltage V(V OUT ) drops to
V(LX)
Vt(V OUT ) to restart the start-up
sequence
Over-Temperature Tj > Toff
on chip
Disables VDD OUT switch and
LX driver and waits until junction
temp drops to “Ton” to restart the
start-up sequence
FIGURE 15. NSYNC TO LX SYNCHRONIZATION DELAY
Maximum Duty Cycle – LX
The maximum duty cycle Dmax, at which the power FET can
operate defines the upper limit of the regulator output to
input voltage ratio according to Equation 2:
V(NSYNC)
V OUT 1
---------------- = --------------------------
V IN 1 – D MAX
(EQ. 2)
In the ISL97701, D MAX is defined from the minimum off-time
t OFF (LX)min and the switching frequency.
If NSYNC is tied to VDD the internal oscillator defines D MAX
according to Equation 3:
V(LX)
D MAX ( f OSC ) = 1 – t OFF ( LX ) min ? f OSC
With external synchronization at pin NSYNC:
(EQ. 3)
D MAX ( NSYNC ) = 1 – t OFF ( LX ) min ? f ( NSYNC )
(EQ. 4)
FIGURE 16. LX SYNCHRONIZATION WITH f(SYNC) = 600kHz
The duty cycle at LX can be 0% (pulse skipping), if the
output voltage exceeds the target voltage set with the
feedback resistors.
Internal Schottky Diode – LX, V OUT
The inductor node LX internally connects to the power FET
and to the anode of the integrated power Schottky diode.
The cathode of the diode is pin V OUT . An overvoltage
detector at V OUT continuously monitors the cathode voltage
and immediately disables the boost regulator if the voltage
exceeds the maximum allowable voltage.
External Synchronization Pin - NSYNC
Pin NSYNC can be used to synchronize the LX output pin with
an external clock signal in the range from 600kHz to 1.4MHz.
A frequency detector monitoring NSYNC enables external
synchronization if f(NSYNC) is higher than ~300kHz. If the
8
V(NSYNC)
V(LX)
FIGURE 17. LX SYNCHRONIZATION WITH f(SYNC) = 1.4MHz
FN6474.1
February 22, 2008
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PDF描述 |
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参数描述 |
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