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参数资料
| 型号： | ISPLSI 2064VE-280LB100 |
| 厂商： | Lattice Semiconductor Corporation |
| 文件页数： | 14/17页 |
| 文件大小： | 0K |
| 描述： | IC PLD ISP 64I/O 3.5NS 100CABGA |
| 标准包装： | 184 |
| 系列： | ispLSI® 2000VE |
| 可编程类型： | 系统内可编程 |
| 最大延迟时间 tpd(1)： | 3.5ns |
| 电压电源 - 内部： | 3 V ~ 3.6 V |
| 逻辑元件/逻辑块数目： | 16 |
| 宏单元数： | 64 |
| 门数： | 2000 |
| 输入/输出数： | 64 |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 100-LFBGA |
| 供应商设备封装： | 100-CABGA（10x10） |
| 包装： | 托盘 |
| 其它名称： | ISPLSI2064VE-280LB100 |
6
Specifications ispLSI 2064VE
External Timing Parameters
Over Recommended Operating Conditions
tpd1
UNITS
-100
MIN.
TEST
COND.
1. Unless noted otherwise, all parameters use a GRP load of four, 20 PTXOR path, ORP and Y0 clock.
2. Standard 16-bit counter using GRP feedback.
3. Reference Switching Test Conditions section.
Table 2-0030B/2064VE v.0.0
1
3
2
1
tsu2 + tco1
(
)
MAX.
DESCRIPTION
#
PARAMETER
A1
Data Propagation Delay, 4PT Bypass, ORP Bypass
–
10.0
ns
tpd2
A2
Data Propagation Delay
–
ns
fmax
A3
Clock Frequency with Internal Feedback
100
–
MHz
fmax (Ext.)
–4
Clock Frequency with External Feedback
–
MHz
fmax (Tog.)
–5
Clock Frequency, Max. Toggle
–
MHz
tsu1
–6
GLB Reg. Setup Time before Clock, 4 PT Bypass
–
ns
tco1
A7
GLB Reg. Clock to Output Delay, ORP Bypass
–
ns
th1
–8
GLB Reg. Hold Time after Clock, 4 PT Bypass
0.0
ns
tsu2
–9
GLB Reg. Setup Time before Clock
8.0
ns
tco2
A10
GLB Reg. Clock to Output Delay
–
ns
th2
–11
GLB Reg. Hold Time after Clock
0.0
ns
tr1
A12
Ext. Reset Pin to Output Delay, ORP Bypass
–
ns
trw1
–13
Ext. Reset Pulse Duration
6.5
ns
tptoeen
B14
Input to Output Enable
–
ns
tptoedis
C15
Input to Output Disable
–
ns
tgoeen
B16
Global OE Output Enable
–
ns
tgoedis
C17
Global OE Output Disable
–
ns
twh
–18
External Synchronous Clock Pulse Duration, High
5.0
–
ns
twl
–19
External Synchronous Clock Pulse Duration, Low
5.0
–
ns
77
100
6.5
5.0
–
6.0
–
12.5
–
15.0
9.0
13.0
-135
MIN. MAX.
–
7.5
–
135
–
0.0
6.0
–
0.0
–
5.0
–
3.5
–
3.5
–
100
143
5.0
4.0
–
5.0
–
9.0
–
12.0
7.0
10.0
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PDF描述 |
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参数描述 |
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| ISPLSI2064VE-280LTN100 | 功能描述:CPLD - 复杂可编程逻辑器件 RoHS:否 制造商:Lattice 系列: 存储类型:EEPROM 大电池数量:128 最大工作频率:333 MHz 延迟时间:2.7 ns 可编程输入/输出端数量:64 工作电源电压:3.3 V 最大工作温度:+ 90 C 最小工作温度:0 C 封装 / 箱体:TQFP-100 |
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