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参数资料
| 型号： | ISPLSI 2192VE-135LB144 |
| 厂商： | Lattice Semiconductor Corporation |
| 文件页数： | 11/15页 |
| 文件大小： | 0K |
| 描述： | IC PLD ISP 96I/O 7.5NS 144FPBGA |
| 标准包装： | 160 |
| 系列： | ispLSI® 2000VE |
| 可编程类型： | 系统内可编程 |
| 最大延迟时间 tpd(1)： | 7.5ns |
| 电压电源 - 内部： | 3 V ~ 3.6 V |
| 逻辑元件/逻辑块数目： | 48 |
| 宏单元数： | 192 |
| 门数： | 8000 |
| 输入/输出数： | 96 |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 144-BGA |
| 供应商设备封装： | 144-FPBGA（13x13） |
| 包装： | 托盘 |
| 其它名称： | ISPLSI2192VE-135LB144 |
Specifications ispLSI 2192VE
5
External Timing Parameters
Over Recommended Operating Conditions
USE
2192VE-225
FOR
NEW
DESIGNS
tpd1
UNITS
TEST
COND.
1. Unless noted otherwise, all parameters use a GRP load of four, 20 PTXOR path, ORP and Y0 clock.
2. Standard 16-bit counter using GRP feedback.
3. Reference Switching Test Conditions section.
Table 2-0030A/2192VE
1
3
2
1
tsu2 + tco1
(
)
DESCRIPTION
#
PARAMETER
A1
Data Propagation Delay, 4PT Bypass, ORP Bypass
ns
tpd2
A2
Data Propagation Delay
ns
fmax
A3
Clock Frequency with Internal Feedback
MHz
fmax (Ext.)
–4
Clock Frequency with External Feedback
MHz
fmax (Tog.)
–5
Clock Frequency, Max. Toggle
MHz
tsu1
–6
GLB Reg. Setup Time before Clock, 4 PT Bypass
ns
tco1
A7
GLB Reg. Clock to Output Delay, ORP Bypass
ns
th1
–8
GLB Reg. Hold Time after Clock, 4 PT Bypass
ns
tsu2
–9
GLB Reg. Setup Time before Clock
ns
tco2
A10
GLB Reg. Clock to Output Delay
ns
th2
–11
GLB Reg. Hold Time after Clock
ns
tr1
A12
Ext. Reset Pin to Output Delay, ORP Bypass
ns
trw1
–13
Ext. Reset Pulse Duration
ns
tptoeen
B14
Input to Output Enable
ns
tptoedis
C15
Input to Output Disable
ns
tgoeen
B16
Global OE Output Enable
ns
tgoedis
C17
Global OE Output Disable
ns
twh
–18
External Synchronous Clock Pulse Duration, High
ns
twl
–19
External Synchronous Clock Pulse Duration, Low
ns
-180
MIN. MAX.
–
5.0
–
180
–
0.0
4.5
–
0.0
–
4.0
–
2.5
–
2.5
–
125
200
3.5
–
4.5
–
7.0
–
10.0
5.0
7.5
-225
MIN. MAX.
–
4.0
–
225
–
0.0
3.5
–
0.0
–
3.5
–
2.0
–
2.0
–
150
250
2.5
3.2
–
3.7
–
6.0
–
6.0
4.5
6.2
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
| ISPLSI2192VE-135LB144 | 功能描述:CPLD - 复杂可编程逻辑器件 RoHS:否 制造商:Lattice 系列: 存储类型:EEPROM 大电池数量:128 最大工作频率:333 MHz 延迟时间:2.7 ns 可编程输入/输出端数量:64 工作电源电压:3.3 V 最大工作温度:+ 90 C 最小工作温度:0 C 封装 / 箱体:TQFP-100 |
| ISPLSI2192VE-135-LB144 | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:3.3V In-System Programmable SuperFAST⑩ High Density PLD |
| ISPLSI2192VE135LB144I | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:3.3V In-System Programmable SuperFAST⑩ High Density PLD |
| ISPLSI2192VE135LT128 | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:3.3V In-System Programmable SuperFAST⑩ High Density PLD |
| ISPLSI2192VE-135LT128 | 功能描述:CPLD - 复杂可编程逻辑器件 RoHS:否 制造商:Lattice 系列: 存储类型:EEPROM 大电池数量:128 最大工作频率:333 MHz 延迟时间:2.7 ns 可编程输入/输出端数量:64 工作电源电压:3.3 V 最大工作温度:+ 90 C 最小工作温度:0 C 封装 / 箱体:TQFP-100 |
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