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参数资料
| 型号： | KMPC8358VRAGDDA |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 52/95页 |
| 文件大小： | 0K |
| 描述： | IC MPU POWERQUICC II PRO 668PBGA |
| 标准包装： | 2 |
| 系列： | MPC83xx |
| 处理器类型： | 32-位 MPC83xx PowerQUICC II Pro |
| 速度： | 400MHz |
| 电压： | 1.2V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 668-BBGA 裸露焊盘 |
| 供应商设备封装： | 668-PBGA-PGE（29x29） |
| 包装： | 托盘 |
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MPC8358E PowerQUICC II Pro Processor Revision 2.1 PBGA Silicon Hardware Specifications, Rev. 3
56
Freescale Semiconductor
SPI
16.1
SPI DC Electrical Characteristics
Table 54 provides the DC electrical characteristics for the device SPI.
16.2
SPI AC Timing Specifications
Table 55 and provide the SPI input and output AC timing specifications.
Figure 40 provides the AC test load for the SPI.
Figure 40. SPI AC Test Load
Table 54. SPI DC Electrical Characteristics
Characteristic
Symbol
Condition
Min
Max
Unit
Output high voltage
VOH
IOH = –6.0 mA
2.4
—
V
Output low voltage
VOL
IOL = 6.0 mA
—
0.5
V
Output low voltage
VOL
IOL = 3.2 mA
—
0.4
V
Input high voltage
VIH
—2.0
OVDD + 0.3
V
Input low voltage
VIL
—
–0.3
0.8
V
Input current
IIN
0 V
≤ VIN ≤ OVDD
—±10
μA
Table 55. SPI AC Timing Specifications1
Characteristic
Symbol2
Min
Max
Unit
SPI outputs—Master mode (internal clock) delay
tNIKHOX
tNIKHOV
0.4
—
8
ns
SPI outputs—Slave mode (external clock) delay
tNEKHOX
tNEKHOV
2
—
8
ns
SPI inputs—Master mode (internal clock) input setup time
tNIIVKH
8—
ns
SPI inputs—Master mode (internal clock) input hold time
tNIIXKH
0—
ns
SPI inputs—Slave mode (external clock) input setup time
tNEIVKH
4—
ns
SPI inputs—Slave mode (external clock) input hold time
tNEIXKH
2—
ns
Notes:
1. Output specifications are measured from the 50% level of the rising edge of CLKIN to the 50% level of the signal. Timings
are measured at the pin.
2. The symbols used for timing specifications follow the pattern of t(first two letters of functional block)(signal)(state)(reference)(state) for
inputs and t(first two letters of functional block)(reference)(state)(signal)(state) for outputs. For example, tNIKHOV symbolizes the NMSI
outputs internal timing (NI) for the time tSPI memory clock reference (K) goes from the high state (H) until outputs (O) are
valid (V).
Output
Z0 = 50 Ω
OVDD/2
RL = 50 Ω
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