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参数资料
| 型号： | KSZ8842-16MVL |
| 厂商： | Micrel Inc |
| 文件页数： | 104/141页 |
| 文件大小： | 0K |
| 描述： | IC ETHERNET SW 2PORT BUS 128LQFP |
| 标准包装： | 90 |
| 控制器类型： | 以太网开关控制器 |
| 接口： | PCI |
| 电源电压： | 3.1 V ~ 3.5 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 128-LQFP |
| 供应商设备封装： | 128-LQFP（14x14） |
| 包装： | 托盘 |
| 产品目录页面： | 1081 (CN2011-ZH PDF) |
| 配用： | 576-1635-ND - BOARD EVALUATION KSZ8842-16MVL |
| 其它名称： | 576-2119 KSZ8842-16MVL-ND |
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Micrel, Inc.
KSZ8842-16/32 MQL/MVL/MVLI/MBL
October 2007
65
M9999-102207-1.9
Bank 16 Transmit Control Register (0x00): TXCR
This register holds control information programmed by the CPU to control the QMU transmit module function.
Bit
Default Value
R/W
Description
15
-
RO
Reserved
14
0x0
RW
Reserved
13
0x0
RW
Reserved
12-4
-
RO
Reserved
3
0x0
RW
TXFCE Transmit Flow Control Enable
When this bit is set, the QMU sends flow control pause frames from the host port if the
RX FIFO has reached its threshold.
Note: the SGCR3[5] in Bank 32 also needs to be enabled.
2
0x0
RW
TXPE Transmit Padding Enable
When this bit is set, the KSZ8842M automatically adds a padding field to a packet
shorter than 64 bytes.
Note: Setting this bit requires enabling the ADD CRC feature to avoid CRC errors for
the transmit packet.
1
0x0
RW
TXCE Transmit CRC Enable
When this bit is set, the KSZ8842M automatically adds a CRC checksum field to the
end of a transmit frame.
0
0x0
RW
TXE Transmit Enable
When this bit is set, the transmit module is enabled and placed in a running state.
When reset, the transmit process is placed in the stopped state after the transmission
of the current frame is completed.
Bank 16 Transmit Status Register (0x02): TXSR
This register keeps the status of the last transmitted frame.
Bit
Default Value
R/W
Description
15-6
0x000
RO
Reserved
5-0
-
RO
TXFID Transmit Frame ID
This field identifies the transmitted frame. All of the transmit status information in this
register belongs to the frame with this ID.
Bank 16 Receive Control Register (0x04): RXCR
This register holds control information programmed by the CPU to control the receive function.
Bit
Default Value
R/W
Description
15-11
-
RO
Reserved
10
0x0
RW
RXFCE Receive Flow Control Enable
When this bit is set, the KSZ8842M will acknowledge a PAUSE frame from the receive
interface; i.e., the outgoing packets are pending in the transmit buffer until the PAUSE
frame control timer expires. When this bit is cleared, flow control is not enabled.
9
0x0
RW
RXEFE Receive Error Frame Enable
When this bit is set, CRC error frames are allowed to be received into the RX queue.
When reset, all CRC error frames are discarded.
8
-
RO
Reserved
7
0x0
RW
RXBE Receive Broadcast Enable
When this bit is set, the RX module receives all the broadcast frames.
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PDF描述 |
|---|---|
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参数描述 |
|---|---|
| KSZ8842-16MVL TR | 功能描述:以太网 IC 2-Port Ethernet Switch/Repeater + Generic (8, 16-bit) bus interface(Lead Free) RoHS:否 制造商:Micrel 产品:Ethernet Switches 收发器数量:2 数据速率:10 Mb/s, 100 Mb/s 电源电压-最大:1.25 V, 3.45 V 电源电压-最小:1.15 V, 3.15 V 最大工作温度:+ 85 C 封装 / 箱体:QFN-64 封装:Tray |
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| KSZ8842-32 | 制造商:MICREL 制造商全称:Micrel Semiconductor 功能描述:2-Port Ethernet Switch with Non-PCI Interface |
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