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参数资料
| 型号： | KXPC8240LVV200E |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 6/52页 |
| 文件大小： | 0K |
| 描述： | IC MPU INTEGRATED 250MHZ 352TBGA |
| 标准包装： | 2 |
| 系列： | MPC82xx |
| 处理器类型： | 32-位 MPC82xx PowerQUICC II |
| 速度： | 200MHz |
| 电压： | 2.5V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 352-LBGA |
| 供应商设备封装： | 352-TBGA（35x35） |
| 包装： | 托盘 |
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14
MPC8240 Integrated Processor Hardware Specifications
Electrical and Thermal Characteristics
Figure 7. DLL Locking Range Loop Delay vs. Frequency of Operation
1.4.2.3
Input AC Timing Specifications
Table 8 provides the input AC timing specifications. See Figure 8 and Figure 9 for the input-output timing
diagrams referenced to SDRAM_SYNC_IN and PCI_SYNC_IN, respectively.
Table 8. Input AC Timing Specifications
Num
Characteristic
Min
Max
Unit
Notes
10a
PCI input signals valid to PCI_SYNC_IN (input setup)
2.0
—
ns
2, 3
10b1 Memory control and data input signals in flow through mode valid to
SDRAM_SYNC_IN (input setup)
3.0
—
ns
1, 3
10b2 Memory control and data input signals in registered/in-line mode valid
to SDRAM_SYNC_IN (input setup)
2.5
—
ns
1, 3
10b3 Memory control and data signals accessing non-DRAM valid to
SDRAM_SYNC_IN (input setup)
3.0
—
ns
1, 3
10c
PIC, miscellaneous debug input signals valid to SDRAM_SYNC_IN
(input setup)
3.0
—
ns
1, 3
10d
I2C input signals valid to SDRAM_SYNC_IN (input setup)
2.0
—
ns
1, 3
10e
Mode select inputs valid to HRST_CPU/HRST_CTRL (input setup)
9
× tCLK
—ns
1, 3–5
DLL not guaranteed to lock
N = 1
DLL_STANDARD = 0
N = 1
DLL_STANDARD = 1
N = 2
DLL_STANDARD = 0
DLL will lock
0
Tloop Propagation Delay Time (ns)
T
cl
kSD
R
A
M
_
SYN
C
_
OU
T
Peri
od
a
nd
Freq
uen
cy
10
515
100 MHz
10 ns
50 MHz
20 ns
33 MHz
30 ns
25 MHz
40 ns
N = 2
DLL_STANDARD = 1
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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