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参数资料
| 型号： | L7C174KMB25 |
| 厂商： | LOGIC DEVICES INC |
| 元件分类： | SRAM |
| 英文描述： | 8K X 8 CACHE TAG SRAM, 22 ns, CQCC32 |
| 封装： | CERAMIC, LCC-32 |
| 文件页数： | 3/8页 |
| 文件大小： | 60K |
| 代理商： | L7C174KMB25 |
DEVICES INCORPORATED
L7C174
8K x 8 Cache-Tag Static RAM
03/26/1999–LDS.174-M
3
Special Architecture Static RAMs
ADDRESS
DATA
CLEAR
CE
MATCH
OE
tCLMV
tAVMV
tDVMV
VALID READ DATA-OUT
MATCH VALID
tAXMX
tCHMH
tOLMH
tWLMH
tCLMH
tDXMX
VALID MATCH DATA-IN
tAVAV
WE
L7C174–
35
25
20
15
12
Symbol
Parameter
Min
Max
Min
Max
Min
Max
Min
Max
Min
Max
tAVAV
MATCH Cycle Time
35
25
20
15
12
tAVMV
Address Valid to MATCH Valid
30
22
20
15
12
tAXMX
Address Change to MATCH Change
3
tCLMV
Chip Enable Low to MATCH Valid
20
15
10
8
tCHMH
Chip Enable High to MATCH High
3
tOLMH
Output Enable Low to MATCH High
3
tWLMH
Write Enable Low to MATCH High
3
tCLMH
CLEAR Low to MATCH High
0
25
0
20
0
15
0
12
0
10
tDVMV
Data Valid to MATCH Valid
20
15
13
10
tDXMX
Data Change to MATCH Change
0
tCLCL
CLEAR Cycle Time
65
55
45
35
30
tCLCH
CLEAR Pulse Width
20
15
12
tCLIX
CLEAR Low to Inputs Don't Care
0
tCLIR
CLEAR Low to Inputs Recognized
70
60
50
45
SWITCHING CHARACTERISTICS Over Operating Range
MATCH AND CLEAR CYCLE Notes 5, 11, 12, 22, 23, 24 (ns)
CLEAR CYCLE
MATCH CYCLE
tCLIR
CLEAR
OE, WE
tCLCH
tCLIX
tCLCL
OBSOLETE
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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