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参数资料
| 型号： | LC5512MB-75F484I |
| 厂商： | LATTICE SEMICONDUCTOR CORP |
| 元件分类： | PLD |
| 中文描述： | EE PLD, 9.5 ns, PBGA484 |
| 封装： | FPBGA-484 |
| 文件页数： | 28/95页 |
| 文件大小： | 923K |
| 代理商： | LC5512MB-75F484I |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页当前第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页
Lattice Semiconductor
ispXPLD 5000MX Family Data Sheet
34
tCASC
Additional Delay for
PT Cascading
between MFBs
—
0.71
—
0.80
—
0.89
—
0.92
—
1.33
ns
tCICOMFB
Carry Chain Delay,
MFB to MFB
—
0.35
—
0.39
—
0.44
—
0.46
—
0.66
ns
tCICOMC
Carry Chain Delay,
Macro-Cell to
Macro-Cell
—
0.10
—
0.11
—
0.13
—
0.13
—
0.19
ns
tFLAG
Routing Delay for
Extended Function
Flags
—
2.62
—
2.94
—
3.27
—
3.40
—
4.91
ns
tFLAGEXP
Additional Flag
Delay when
Expanding Data
Widths
tFLAGFULL,
tFLAGAFULL,
tFLAGEMPTY,
tFLAGAEMPTY
—
2.57
—
2.89
—
3.21
—
3.34
—
4.82
ns
tSUM
Counter Sum Delay
tPTSA
—
0.80
—
0.90
—
1.00
—
1.04
—
1.50
ns
Optional Adjusters
tBLA
Block Loading
Adder
tROUTE
—
0.04
—
0.04
—
0.05
—
0.05
—
0.07
ns
tEXP
PT Expander Adder
tROUTE
—
0.53
—
0.60
—
0.66
—
0.69
—
0.99
ns
tINDIO
Additional Delay for
the Input Register
tINREG
—
0.50
—
0.56
—
0.63
—
0.65
—
0.94
ns
tPLL_SEC_DELAY
Secondary PLL
Output Delay
tPLL_DELAY
—
0.91
—
0.91
—
0.91
—
0.91
—
0.91
ns
tINEXP
MFB Input Extender
tROUTE
—
0.62
—
0.70
—
0.78
—
0.81
—
1.16
ns
Input and Output Buffer Delays
tIOI
Input Buffer Selec-
tion Adder
tGCLK_IN, tIN,
tGOE, tRST
Refer to sysIO Adjuster Tables
ns
tIOO
Output Buffer
Selection Adder
tBUF
ns
FIFO
tFIFOWCLKS
Write Data Setup
before Write Clock
Time
—
-0.27
—
-0.27
—
-0.22
—
-0.22
—
-0.21
—
ns
tFIFOWCLKH
Write Data Hold
after Write Clock
Time
—
-0.01
—
-0.01
—
-0.01
—
-0.01
—
-0.01
—
ns
tFIFOCLKSKEW
Opposite Clock
Cycle Delay
—
1.40
—
1.40
—
1.76
—
1.76
—
1.83
ns
tFIFOFULL
Write Clock to Full
Flag Delay
—
3.08
—
3.08
—
3.85
—
3.85
—
4.00
ns
tFIFOAFULL
Write Clock to
Almost Full Flag
Delay
—
3.08
—
3.08
—
3.86
—
3.86
—
4.01
ns
tFIFOEMPTY
Read Clock to
Empty Flag Delay
—
3.08
—
3.08
—
3.86
—
3.86
—
4.01
ns
tFIFOAEMPTY
Read Clock to
Almost Empty Flag
Delay
—
3.08
—
3.08
—
3.86
—
3.86
—
4.01
ns
ispXPLD 5000MX Family Internal Switching Characteristics (Continued)
Over Recommended Operating Conditions
Parameter
Description
Base
Parameter
-4
-45
-5
-52
-75
Units
Min.
Max.
Min.
Max.
Min.
Max.
Min.
Max.
Min.
Max.
相关PDF资料 |
PDF描述 |
|---|---|
| LC5768MB-5F256C | |
| LC51024MC-75F672I | |
| LC5512MC-75Q208I | |
| LC5512MC-75F256I | |
| LC5256MC-5F256I | |
相关代理商/技术参数 |
参数描述 |
|---|---|
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| LC5512MB-75FN208C | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:3.3V, 2.5V and 1.8V In-System Programmable eXpanded Programmable Logic Device XPLD⑩ Family |
| LC5512MB-75FN208I | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:3.3V, 2.5V and 1.8V In-System Programmable eXpanded Programmable Logic Device XPLD⑩ Family |
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