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参数资料
| 型号： | LFX200EB-05FN256C |
| 厂商： | Lattice Semiconductor Corporation |
| 文件页数： | 82/119页 |
| 文件大小： | 0K |
| 描述： | IC FPGA 210KGATES 256FPBGA |
| 标准包装： | 90 |
| 系列： | ispXPGA® |
| 逻辑元件/单元数： | 2704 |
| RAM 位总计： | 113664 |
| 输入/输出数： | 160 |
| 门数： | 210000 |
| 电源电压： | 2.3 V ~ 3.6 V |
| 安装类型： | 表面贴装 |
| 工作温度： | 0°C ~ 85°C |
| 封装/外壳： | 256-BGA |
| 供应商设备封装： | 256-FPBGA（17x17） |
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Lattice Semiconductor
ispXPGA Family Data Sheet
61
HSImA_CDRRST, HSImB_CDRRST
Input
CDR Reset
HSIm_CSLOCK, HSIm_CSLOCK
Internal Signal Indicates when the CSPLL circuit is locked
sysHSI Block (Source Synchronous Mode)
6
SS_CLKIN0P, SS_CLKIN1P
Input
P-side of differential clock input
SS_CLKIN0N, SS_CLKIN1N
Input
N-side of differential clock input
SS_CLKOUT0P, SS_CLKOUT1P
Output
P-side of differential clock output
SS_CLKOUT0N, SS_CLKOUT1N
Output
N-side of differential clock output
CAL0, CAL1
Input
Initiates source synchronous calibration sequence
1. x is a variable for the I/O number.
2. y is a variable for the I/O Bank.
3. z is a variable for the PLL number.
4. m is a variable for the sysHSI block number.
5. A and B refer to the sysHSI block channels.
6. 0 and 1 refer to Source Synchronous group 0 and 1
7. n is a variable for the GCLK and Input number
8. See Logic Signal Connections Table for differential pairing.
Signal Descriptions
1 (Cont.)
Signal Name
Signal Type
Description
SELECT
DEVICES
DISCONTINUED
相关PDF资料 |
PDF描述 |
|---|---|
| 11AA160T-I/TT | IC EEPROM 16KBIT 100KHZ SOT23-3 |
| 11AA010-I/MS | IC EEPROM 1KBIT 100KHZ 8MSOP |
| ABM44DRKI | CONN EDGECARD 88POS DIP .156 SLD |
| KS8995MAL | IC SWITCH 10/100 5PORT 128PQFP |
| HSC40DRYS-S93 | CONN EDGECARD 80POS DIP .100 SLD |
相关代理商/技术参数 |
参数描述 |
|---|---|
| LFX200EB-05FN516C | 功能描述:FPGA - 现场可编程门阵列 E-Ser210K Gt ispJTA G 2.5/3.3V -5 Spd RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
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