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参数资料
| 型号： | LIS3DH |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 模拟信号调理 |
| 英文描述： | SPECIALTY ANALOG CIRCUIT, PBGA16 |
| 封装： | 3 X 3 MM, 1 MM HEIGHT, GREEN, PLASTIC, LGA-16 |
| 文件页数： | 5/42页 |
| 文件大小： | 689K |
| 代理商： | LIS3DH |
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LIS3DH
Mechanical and electrical specifications
Doc ID 17530 Rev 1
13/42
2.4.2
I2C - Inter IC control interface
Subject to general operating conditions for Vdd and top.
Figure 4.
I2C Slave timing diagram
Note:
Measurement points are done at 0.2Vdd_IO and 0.8Vdd_IO, for both port.
Table 7.
I2C slave timing values
Symbol
Parameter
I2C standard mode (1)
I2C fast mode (1)
Unit
Min
Max
Min
Max
f(SCL)
SCL clock frequency
0
100
0
400
kHz
tw(SCLL)
SCL clock low time
4.7
1.3
s
tw(SCLH)
SCL clock high time
4.0
0.6
tsu(SDA)
SDA setup time
250
100
ns
th(SDA)
SDA data hold time
0.01
3.45
0.01
0.9
s
tr(SDA) tr(SCL)
SDA and SCL rise time
1000
20 + 0.1Cb
(2)
300
ns
tf(SDA) tf(SCL)
SDA and SCL fall time
300
20 + 0.1Cb
(
2)
300
th(ST)
START condition hold time
4
0.6
s
tsu(SR)
Repeated START condition
setup time
4.7
0.6
tsu(SP)
STOP condition setup time
4
0.6
tw(SP:SR)
Bus free time between STOP
and START condition
4.7
1.3
1.
Data based on standard I2C protocol requirement, not tested in production.
2.
Cb = total capacitance of one bus line, in pF.
SDA
SCL
tf(SDA)
tsu(SP)
tw(SCLL)
tsu(SDA)
tr(SDA)
tsu(SR)
th(ST)
tw(SCLH)
th(SDA)
tr(SCL)
tf(SCL)
tw(SP:SR)
START
REPEATED
START
STOP
START
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PDF描述 |
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