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参数资料
| 型号： | LM98725 |
| 厂商： | NATIONAL SEMICONDUCTOR CORP |
| 元件分类： | 模拟信号调理 |
| 英文描述： | SPECIALTY ANALOG CIRCUIT, PDSO56 |
| 封装： | TSSOP-56 |
| 文件页数： | 13/14页 |
| 文件大小： | 464K |
| 代理商： | LM98725 |
Symbol
Parameter
Conditions
Min
Typ
Max
Units
V
IHL
Differential LVDS Clock
R
L = 100
200
mV
High Threshold Voltage
V
CM (LVDS Input Common Mode
Voltage)= 1.25V
V
ILL
Differential LVDS Clock
-200
mV
Low Threshold Voltage
V
IHC
CMOS Clock
INCLK- = DGND
2.0
V
High Threshold Voltage
V
ILC
CMOS Clock
0.8
V
Low Threshold Voltage
I
IHL
CMOS Clock
230
260
μA
Input High Current
I
ILC
CMOS Clock
-135
-120
μA
Input Low Current
LVDS Output DC Specifications
V
OD
Differential Output Voltage
R
L = 100
280
390
490
mV
V
OS
LVDS Output Offset Voltage
1.08
1.20
1.33
V
I
OS
Output Short Circuit Current
V
OUT = 0V, RL = 100
8.5
mA
Power Supply Specifications
IA
VA Analog Supply Current
LVDS Output Data Format
152
180
mA
LVDS Output Data Format
(Powerdown)
3.6
6
mA
CMOS Output Data Format
(40 MHz)
136
168
mA
ID
VD Digital Output Driver Supply
Current
LVDS Output Data Format
76
94
mA
LVDS Output Data Format
(Powerdown)
8.5
17
mA
CMOS Output Data Format
(ATE Loading of CMOS Outputs
> 50 pF) (40 MHz)
46
68
mA
IC
VC CCD Timing Generator Output
Driver Supply Current
Typical sensor outputs:
1
4
mA
SH1-SH5, PHIA, PHIB, PHIC,
RS, CP
(ATE Loading of CMOS
Outputs > 50pF)
PWR
Average Power Dissipation
LVDS Output Data Format
755
885
mW
LVDS Output Data Format
(Powerdown)
40
70
mW
CMOS Output Data Format
(ATE Loading of CMOS Outputs
> 50pF) (40 MHz)
600
740
mW
Input Sampling Circuit Specifications
V
IN
Input Voltage Level
CDS Gain=1x, PGA Gain=1x
2.3
Vp-p
CDS Gain=2x, PGA Gain= 1x
1.22
www.national.com
8
LM98725
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
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