参数资料
| 型号： | LPC11D14FBD100/302 |
| 厂商： | NXP Semiconductors |
| 文件页数： | 155/543页 |
| 文件大小： | 0K |
| 描述： | IC MCU 32BIT 32K 100LQFP |
| 产品培训模块： | Code Density for LPC11xx |
| 标准包装： | 90 |
| 系列： | LPC11Dxx |
| 核心处理器： | ARM? Cortex?-M0 |
| 芯体尺寸： | 32-位 |
| 速度： | 50MHz |
| 连通性： | I²C，Microwire，SPI，SSI，SSP，UART/USART |
| 外围设备： | 欠压检测/复位，LCD，POR，WDT |
| 输入/输出数： | 42 |
| 程序存储器容量： | 32KB（32K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 8K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 1.8 V ~ 3.6 V |
| 数据转换器： | A/D 8x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 100-LQFP |
| 包装： | 托盘 |
| 其它名称： | 568-8564 |
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UM10398
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NXP B.V. 2013. All rights reserved.
User manual
Rev. 12.1 — 7 August 2013
238 of 543
NXP Semiconductors
UM10398
Chapter 15: LPC111x/LPC11Cxx I2C-bus controller
[1] Reset value reflects the data stored in used bits only. It does not include reserved bits content.
15.7.1 I2C Control Set register (I2C0CONSET - 0x4000 0000)
The CONSET registers control setting of bits in the CON register that controls operation of
the I2C interface. Writing a one to a bit of this register causes the corresponding bit in the
I2C control register to be set. Writing a zero has no effect.
I2EN
I2C Interface Enable. When I2EN is 1, the I2C interface is enabled. I2EN can be
cleared by writing 1 to the I2ENC bit in the CONCLR register. When I2EN is 0, the I2C
interface is disabled.
When I2EN is “0”, the SDA and SCL input signals are ignored, the I2C block is in the “not
addressed” slave state, and the STO bit is forced to “0”.
I2C0ADR3
R/W
0x028
I2C Slave Address Register 3.
Contains the 7-bit slave address for
operation of the I2C interface in slave mode, and is not used in master
mode. The least significant bit determines whether a slave responds to
the General Call address.
0x00
I2C0DATA_
BUFFER
RO
0x02C
Data buffer register.
The contents of the 8 MSBs of the I2DAT shift
register will be transferred to the DATA_BUFFER automatically after
every nine bits (8 bits of data plus ACK or NACK) has been received on
the bus.
0x00
I2C0MASK0
R/W
0x030
I2C Slave address mask register 0
. This mask register is associated
with I2ADR0 to determine an address match. The mask register has no
effect when comparing to the General Call address (‘0000000’).
0x00
I2C0MASK1
R/W
0x034
I2C Slave address mask register 1
. This mask register is associated
with I2ADR1 to determine an address match. The mask register has no
effect when comparing to the General Call address (‘0000000’).
0x00
I2C0MASK2
R/W
0x038
I2C Slave address mask register 2
. This mask register is associated
with I2ADR2 to determine an address match. The mask register has no
effect when comparing to the General Call address (‘0000000’).
0x00
I2C0MASK3
R/W
0x03C
I2C Slave address mask register 3
. This mask register is associated
with I2ADR3 to determine an address match. The mask register has no
effect when comparing to the General Call address (‘0000000’).
0x00
Table 219. Register overview: I2C (base address 0x4000 0000) …continued
Name
Access Address
offset
Description
Reset
value[1]
Table 220. I2C Control Set register (I2C0CONSET - address 0x4000 0000) bit description
Bit
Symbol
Description
Reset
value
1:0
-
Reserved. User software should not write ones to reserved bits. The
value read from a reserved bit is not defined.
NA
2
AA
Assert acknowledge flag.
3SI
I2C interrupt flag.
0
4
STO
STOP flag.
0
5
STA
START flag.
0
6I2EN
I2C interface enable.
0
31:7 -
Reserved. The value read from a reserved bit is not defined.
-
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PDF描述 |
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