参数资料
型号: LTC1406IGN#TR
厂商: Linear Technology
文件页数: 12/16页
文件大小: 0K
描述: IC ADC 8BIT 20MSPS SAMPLE 24SSOP
标准包装: 2,500
位数: 8
采样率(每秒): 20M
数据接口: 并联
转换器数目: 1
功率耗散(最大): 225mW
电压电源: 模拟和数字,双 ±
工作温度: -40°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 24-SSOP(0.154",3.90mm 宽)
供应商设备封装: 24-SSOP
包装: 带卷 (TR)
输入数目和类型: 2 个单端,双极;1 个差分,双极
5
LTC1406
TYPICAL PERFORMANCE CHARACTERISTICS
UW
OUTPUT CODE
0
INL
EOC
ERROR
(LSB)
256
1406 G07
64
128
192
1.0
0.5
0
–0.5
–1.0
32
96
160
224
Supply Current vs
Sampling Frequency
SAMPLING FREQUENCY (Hz)
100k
SUPPLY
CURRENT
(mA)
35
30
25
20
15
10
5
0
1M
10M
1406 G09
20M
INPUT FREQUENCY (Hz)
100k
SPURIOUS-FREE
DYNAMIC
RANGE
(dB)
70
60
50
40
30
20
10
0
1M
10M
100M
1406 G04
Intermodulation Distortion Plot
FREQUENCY (MHz)
0
–10
–20
–30
–40
–50
–60
–70
–80
–90
–100
AMPLITUDE
(dB)
1406 G05
0123
4
5
67
8
9
10
fSAMPLE = 20MHz
fIN1 = 3.500977MHz
fIN2 = 3.598633MHz
Differential Nonlinearity
vs Output Code
OUTPUT CODE
0
DNL
EOC
ERROR
(LSB)
256
1406 G06
64
128
192
1.0
0.5
0
–0.5
–1.0
32
96
160
224
INPUT FREQUENCY (Hz)
100k
COMMON
MODE
REJECTION
(dB)
70
60
50
40
30
20
10
0
1M
10M
100M
1406 G08
Input Common Mode Rejection
vs Input Frequency
Integral Nonlinearity
vs Output Code
Spurious-Free Dynamic Range
vs Input Frequency
PIN FUNCTIONS
UU
U
OGND (Pin 1): Digital Data Output Ground. Tie to analog
ground plane. May be tied to logic ground if desired.
OVDD (Pin 2): Digital Data Output Supply. Normally tied to
5V, can be used to interface with 3V digital logic. Bypass
to OGND with 10
F tantalum in parallel with 0.1F or 10F
ceramic.
SHDN (Pin 3): Power Shutdown Input. Logic low selects
shutdown.
VBIAS (Pin 4): Internal Bias Voltage. Internally set to 2.2V.
Bypass to analog ground plane with 10
F tantalum in par-
allel with 0.1
F or 10F ceramic.
VREF (Pin 5): External 2.5V Reference Input. Bypass to
analog ground plane with 10
F tantalum in parallel with
0.1
F or 10F ceramic.
AGND (Pin 6): Analog Ground. Tie to analog ground plane.
AIN+ (Pin 7): ±1V Input. The maximum output code
occurs when [(AIN+) – (AIN–)] = 1V. The minimum output
code occurs when [(AIN
+) – (AIN–)] = –1V.
AIN– (Pin 8): ±1V Input. The maximum output code
occurs when [(AIN+) – (AIN–)] = 1V. The minimum output
code occurs when [(AIN
+) – (AIN–)] = –1V. For single-
ended operation, tie AIN– to a DC voltage (e.g., VREF).
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