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参数资料
| 型号： | LTC1605AISW#TRPBF |
| 厂商： | Linear Technology |
| 文件页数： | 14/16页 |
| 文件大小： | 0K |
| 描述： | IC A/D CONV 16BIT SAMPLNG 28SOIC |
| 标准包装： | 1,000 |
| 位数： | 16 |
| 采样率（每秒）： | 100k |
| 数据接口： | 并联 |
| 转换器数目： | 1 |
| 功率耗散（最大）： | 80mW |
| 电压电源： | 模拟和数字 |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 28-SOIC（0.295"，7.50mm 宽） |
| 供应商设备封装： | 28-SOIC |
| 包装： | 带卷 (TR) |
| 输入数目和类型： | 1 个单端，双极 |
| 配用： | DC1255A-A-ND - BOARD SAR ADC LTC1605 |
7
1605fc
LTC1605
PIN FUNCTIONS
UU
U
on Pin 15 and bit 8 is output on Pin 22. Bit 7 is output on
Pin 6 and the LSB is output on Pin 13.
R/C (Pin 24): Read/Convert Input. With CS low, a falling
edge on R/C puts the internal sample-and-hold into the
hold state and starts a conversion. With CS low, a rising
edge on R/C enables the output data bits.
CS (Pin 25): Chip Select. Internally OR’d with R/C. With
R/C low, a falling edge on CS will initiate a conversion.
With R/C high, a falling edge on CS will enable the output
data.
BUSY (Pin 26): Output Shows Converter Status. It is low
when a conversion is in progress. Data valid on the rising
edge of BUSY. CS or R/C must be high when BUSY rises
or another conversion will start without time for signal
acquisition.
VANA (Pin 27): 5V Analog Supply. Bypass to ground with
a 0.1
F ceramic and a 10F tantalum capacitor.
VDIG (Pin 28): 5V Digital Supply. Connect directly to Pin
27.
TEST CIRCUITS
Load Circuit for Access Timing
1k
CL
DBN
1k
5V
LTC1605 TC01
A. HI-Z TO VOH AND VOL TO VOH
B. HI-Z TO VOL AND VOH TO VOL
Load Circuit for Output Float Delay
1k
50pF
DBN
1k
5V
LTC1605 TC02
A. VOH TO HI-Z
B. VOL TO HI-Z
FUNCTIONAL BLOCK DIAGRA
UU
W
16-BIT CAPACITIVE DAC
COMP
REF BUF
2.5V REF
CAP
(2.5V)
CSAMPLE
D15
D0
BUSY
CONTROL LOGIC
R/C
BYTE
INTERNAL
CLOCK
CS
ZEROING SWITCHES
VDIG
VANA
VIN
REF
AGND1
AGND2
DGND
16
LTC1605 BD
+
–
SUCCESSIVE APPROXIMATION
REGISTER
OUTPUT LATCHES
4k
20k
4k
10k
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PDF描述 |
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