参数资料
型号: LTC1709EG#PBF
厂商: Linear Technology
文件页数: 3/28页
文件大小: 0K
描述: IC REG CTRLR BUCK PWM CM 36-SSOP
标准包装: 37
PWM 型: 电流模式
输出数: 1
频率 - 最大: 360kHz
占空比: 99.5%
电源电压: 4 V ~ 36 V
降压:
升压:
回扫:
反相:
倍增器:
除法器:
Cuk:
隔离:
工作温度: -40°C ~ 85°C
封装/外壳: 36-SSOP(0.209",5.30mm 宽)
包装: 管件
LTC1709
ELECTRICAL CHARACTERISTICS The q denotes the specifications which apply over the full operating
temperature range, otherwise specifications are at T A = 25 ° C. V IN = 15V, V RUN/SS = 5V unless otherwise noted.
SYMBOL
V RUN/SSLO
I SCL
PARAMETER
RUN/SS Pin Latchoff Arming
RUN/SS Discharge Current
CONDITIONS
V RUN/SS Rising from 3V
Soft Short Condition V EAIN = 0.5V;
MIN
0.5
TYP
4.1
2
MAX
4.5
4
UNITS
V
μ A
V RUN/SS = 4.5V
I SDLHO
Shutdown Latch Disable Current
V EAIN = 0.5V
1.6
5
μ A
I SENSE
DF MAX
Total Sense Pins Source Current
Maximum Duty Factor
Each Channel: V SENSE1 – , 2 – = V SENSE1 + , 2 + = 0V
In Dropout
– 85
98
– 60
99.5
μ A
%
Top Gate Transition Time:
(Note 6)
TG1, 2 t r
TG1, 2 t f
Rise Time
Fall Time
C LOAD = 3300pF
C LOAD = 3300pF
30
40
90
90
ns
ns
Bottom Gate Transition Time:
(Note 6)
BG1, 2 t r
BG1, 2 t f
Rise Time
Fall Time
C LOAD = 3300pF
C LOAD = 3300pF
30
20
90
90
ns
ns
TG/BG t 1D
Top Gate Off to Bottom Gate On Delay
(Note 6)
BG/TG t 2D
Synchronous Switch-On Delay Time
Bottom Gate Off to Top Gate On Delay
Top Switch-On Delay Time
C LOAD = 3300pF Each Driver
(Note 6)
C LOAD = 3300pF Each Driver
90
90
ns
ns
t ON(MIN)
Minimum On-Time
Tested with a Square Wave (Note 7)
180
200
ns
Internal V CC Regulator
V INTVCC
V LDO INT
V LDO EXT
Internal V CC Voltage
INTV CC Load Regulation
EXTV CC Voltage Drop
6V < V IN < 30V; V EXTVCC = 4V
I CC = 0 to 20mA; V EXTVCC = 4V
I CC = 20mA; V EXTVCC = 5V
4.8
5.0
0.2
120
5.2
1.0
240
V
%
mV
V EXTVCC
V LDOHYS
EXTV CC Switchover Voltage
EXTV CC Switchover Hysteresis
I CC = 20mA, EXTV CC Ramping Positive
I CC = 20mA, EXTV CC Ramping Negative
q
4.5
4.7
0.2
V
V
VID Parameters
R ATTEN
Resistance Between ATTENIN and
20
k ?
ATTENOUT Pins
ATTEN ERR
R PULLUP
Resistive Divider Worst-Case Error
VID0–VID4 Pull-Up Resistance
Programmed from 1.3V to 2.05V (VID4 = 0)
Programmed from 2.1V to 3.5V (VID4 = 1)
(Note 8)
q
q
– 0.25
– 0.35
40
+ 0.25
+ 0.25
%
%
k ?
VID THLOW
VID THHIGH
VID0–VID4 Logic Threshold Low
VID0–VID4 Logic Threshold High
1.6
0.4
V
V
VID LEAK
VID0–VID4 Leakage
V BIAS < VID0–VID4 < 7V
1
μ A
Oscillator and Phase-Locked Loop
f NOM
f LOW
f HIGH
Nominal Frequency
Lowest Frequency
Highest Frequency
V PLLFLTR = 1.2V
V PLLFLTR = 0V
V PLLFLTR ≥ 2.4V
190
120
280
220
140
310
250
160
360
kHz
kHz
kHz
R PLLIN
PLLIN Input Resistance
50
k ?
I PLLFLTR
R RELPHS
Phase Detector Output Current
Sinking Capability
Sourcing Capability
Controller 2-Controller 1 Phase
f PLLIN < f OSC
f PLLIN > f OSC
– 15
15
180
μ A
μ A
Deg
Differential Amplifier/Op Amp Gain Block (Note 9)
A DA
CMRR DA
Gain
Common Mode Rejection Ratio
Differential Amp Mode
Differential Amp Mode; 0V < V CM < 5V
0.995
46
1
55
1.005
V/V
dB
3
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