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参数资料
| 型号： | LTC1709EG#PBF |
| 厂商： | Linear Technology |
| 文件页数： | 7/28页 |
| 文件大小： | 0K |
| 描述： | IC REG CTRLR BUCK PWM CM 36-SSOP |
| 标准包装： | 37 |
| PWM 型： | 电流模式 |
| 输出数： | 1 |
| 频率 - 最大： | 360kHz |
| 占空比： | 99.5% |
| 电源电压： | 4 V ~ 36 V |
| 降压： | 是 |
| 升压： | 无 |
| 回扫： | 无 |
| 反相： | 无 |
| 倍增器： | 无 |
| 除法器： | 无 |
| Cuk： | 无 |
| 隔离： | 无 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 36-SSOP（0.209"，5.30mm 宽） |
| 包装： | 管件 |
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LTC1709
TYPICAL PERFOR A CE CHARACTERISTICS
350
Oscillator Frequency
vs Temperature
3.50
Undervoltage Lockout
vs Temperature
4.5
V RUN/SS Shutdown Latch
Thresholds vs Temperature
300
V FREQSET = 5V
3.45
4.0
LATCH ARMING
3.5
250
200
150
100
V FREQSET = OPE N
V FREQSET = 0V
3.40
3.35
3.30
3.0
2.5
2.0
1.5
LATCHOFF
THRESHOLD
1.0
50
0
3.25
3.20
0.5
0
– 50 – 25
0
25
50
75
100
125
–50 –25
0
25
50
75
100
125
–50
–25
0 25
50
75
100
125
TEMPERATURE ( ° C)
PI FU CTIO S
1709 G23
TEMPERATURE ( ° C)
1709 G24
TEMPERATURE ( ° C)
1709 G25
RUN/SS (Pin 1): Combination of Soft-Start, Run Control
Input and Short-Circuit Detection Timer. A capacitor to
ground at this pin sets the ramp time to full current output.
Forcing this pin below 0.8V causes the IC to shut down all
internal circuitry. All functions are disabled in shutdown.
SENSE 1 + , SENSE 2 + (Pins 2,14): The (+) Input to Each
Differential Current Comparator. The I TH pin voltage and
built-in offsets between SENSE – and SENSE + pins in
conjunction with R SENSE set the current trip threshold.
SENSE 1 – , SENSE 2 – (Pins 3, 13): The (–) Input to the
Differential Current Comparators.
EAIN (Pin 4): Input to the Error Amplifier that compares
the feedback voltage to the internal 0.8V reference voltage.
This pin is normally connected to a resistive divider from
the output of the differential amplifier (DIFFOUT).
PLLFLTR (Pin 5): The Phase-Locked Loop’s Low Pass
Filter is tied to this pin. Alternatively, this pin can be driven
with an AC or DC voltage source to vary the frequency of
the internal oscillator.
PLLIN (Pin 6): External Synchronization Input to Phase
Detector. This pin is internally terminated to SGND with
50k ? . The phase-locked loop will force the rising top gate
signal of controller 1 to be synchronized with the rising
edge of the PLLIN signal.
NC (Pins 7, 36): Do not connect.
I TH (Pin 8): Error Amplifier Output and Switching Regula-
tor Compensation Point. Both current comparator’s thresh-
olds increase with this control voltage. The normal voltage
range of this pin is from 0V to 2.4V
SGND (Pin 9): Signal Ground, common to both control-
lers. Route separately to the PGND pin.
V DIFFOUT (Pin 10): Output of a Differential Amplifier that
provides true remote output voltage sensing. This pin
normally drives an external resistive divider that sets the
output voltage.
V OS– , V OS+ (Pins 11, 12): Inputs to an Operational Ampli-
fier. Internal precision resistors capable of being elec-
tronically switched in or out can configure it as a differen-
tial amplifier or an uncommitted Op Amp.
ATTENOUT (Pin 15): Voltage Feedback Signal Resistively
Divided According to the VID Programming Code.
ATTENIN (Pin 16): The Input to the VID Controlled Resis-
tive Divider.
VID0–VID4 (Pins 17,18, 19, 20, 21): VID Control Logic
Input Pins.
V BIAS (Pin 22): Supply Pin for the VID Control Circuit.
7
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