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参数资料
| 型号： | LTC3736EGN-1#TR |
| 厂商： | Linear Technology |
| 文件页数： | 7/28页 |
| 文件大小： | 0K |
| 描述： | IC REG CTRLR BUCK PWM CM 24-SSOP |
| 标准包装： | 2,500 |
| 系列： | PolyPhase® |
| PWM 型： | 电流模式 |
| 输出数： | 2 |
| 频率 - 最大： | 825kHz |
| 占空比： | 100% |
| 电源电压： | 2.75 V ~ 9.8 V |
| 降压： | 是 |
| 升压： | 无 |
| 回扫： | 无 |
| 反相： | 无 |
| 倍增器： | 无 |
| 除法器： | 无 |
| Cuk： | 无 |
| 隔离： | 无 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 24-SSOP（0.154"，3.90mm 宽） |
| 包装： | 带卷 (TR) |
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LTC3736-1
PI FU CTIO S
(UF/GN Package)
TG1/TG2 (Pins 17, 15/Pins 20, 18): Top (PMOS) Gate Drive
Output. These pins drive the gates of the external P-channel
MOSFETs. These pins have an output swing from PGND to
SENSE + .
SSDIS (Pin 18/Pin 21): Spread Spectrum Disable Input. Tie
this pin to V IN to disable spread spectrum operation. In this
mode, the LTC3736-1 operates at a constant frequency
determined by the voltage on the FREQ pin. Tie this pin to
GND to enable spread spectrum operation.
BG1/BG2 (Pins 19, 13/Pins 22, 16): Bottom (NMOS) Gate
Drive Output. These pins drive the gates of the external N-
channel MOSFETs. These pins have an output swing from
PGND to SENSE + .
SENSE1 + /SENSE2 + (Pins 21, 11/Pins 24, 14): Positive
Input to Differential Current Comparator. Also powers the
gate drivers. Normally connected to the source of the ex-
ternal P-channel MOSFET.
SW1/SW2 (Pins 22, 10/Pins 1, 13): Switch Node Connec-
tion to Inductor. Also the negative input to differential peak
current comparator and an input to the reverse current
comparator. Normally connected to the drain of the exter-
nal P-channel MOSFETs, the drain of the external N-channel
MOSFET and the inductor.
IPRG1/IPRG2 (Pins 23, 2/Pins 2, 5): Three-State Pins to
Select Maximum Peak Sense Voltage Threshold. These pins
select the maximum allowed voltage drop between the
SENSE + and SW pins (i.e., the maximum allowed drop
across the external P-channel MOSFET) for each channel.
Tie to V IN , GND or float to select 204mV, 85mV or 125mV
respectively.
V FB1 /V FB2 (Pins 24, 7/Pins 3, 10): Feedback Pins. Receives
the remotely sensed feedback voltage for its controller from
an external resistor divider across the output.
Exposed Pad (Pin 25/NA): The exposed pad (UF Package)
must be soldered to the PCB ground.
FU CTIO AL DIAGRA
(Common Circuitry)
R VIN
V IN
UNDERVOLTAGE
LOCKOUT
V IN
VOLTAGE
REFERENCE
C VIN
0.6V
V REF
(TO CONTROLLER 1, 2)
RUN/SS
0.7 μ A
SHDN
EXTSS
t SEC = 1ms
+
INTSS
–
SSDIS
FREQ
SPREAD
SPECTRUM
OSCILLATOR
CLK1
CLK2
SLOPE
COMP
SLOPE1
SLOPE2
V FB1
IPRG1
0.54V
UV1
OV1
SHDN
PGOOD
CONTROLLED
OSCILLATOR
IPRG2
VOLTAGE
MAXIMUM
SENSE VOLTAGE
SELECT
IPROG1
IPROG2
V FB2
+
–
UV2
OV2
37361 FD
37361f
7
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PDF描述 |
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