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参数资料
| 型号： | LTC3851IUD#TRPBF |
| 厂商： | Linear Technology |
| 文件页数： | 22/28页 |
| 文件大小： | 0K |
| 描述： | IC REG CTRLR BUCK PWM CM 16-QFN |
| 产品培训模块： | LTC3851 Single Output DC/DC Switching Regulator Controller |
| 特色产品： | Wide Input Voltage Range Synchronous Step-Down DC/DC Controller |
| 标准包装： | 2,500 |
| PWM 型： | 电流模式 |
| 输出数： | 1 |
| 频率 - 最大： | 790kHz |
| 占空比： | 99% |
| 电源电压： | 4 V ~ 38 V |
| 降压： | 是 |
| 升压： | 无 |
| 回扫： | 无 |
| 反相： | 无 |
| 倍增器： | 无 |
| 除法器： | 无 |
| Cuk： | 无 |
| 隔离： | 无 |
| 工作温度： | -40°C ~ 125°C |
| 封装/外壳： | 16-WFQFN 裸露焊盘 |
| 包装： | 带卷 (TR) |
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LTC3851
APPLICATIONS INFORMATION
C LOAD to C OUT is greater than 1:50, the switch rise time
should be controlled so that the load rise time is limited
to approximately 25 ? C LOAD . Thus a 10μF capacitor would
require a 250μs rise time, limiting the charging current
to about 200mA.
PC Board Layout Checklist
When laying out the printed circuit board, the following
checklist should be used to ensure proper operation of
the LTC3851. These items are also illustrated graphically
in the layout diagram of Figure 9. Check the following in
your layout:
1. Are the board signal and power grounds segregated?
The LTC3851 GND pin should tie to the ground plane
close to the input capacitor(s). The low current or signal
ground lines should make a single point tie directly to
2. Does the V FB pin connect directly to the feedback resis-
tors? The resistive divider R1, R2 must be connected
between the (+) plate of C OUT and signal ground. The
47pF to 100pF capacitor should be as close as possible
to the LTC3851. Be careful locating the feedback resis-
tors too far away from the LTC3851. The V FB line should
not be routed close to any other nodes with high slew
rates.
3. Are the SENSE – and SENSE + leads routed together
with minimum PC trace spacing? The ?lter capaci-
tor between SENSE + and SENSE – should be as close
as possible to the LTC3851. Ensure accurate current
sensing with Kelvin connections as shown in Figure
10. Series resistance can be added to the SENSE lines
to increase noise rejection and to compensate for the
ESL of R SENSE .
the GND pin. The synchronous MOSFET source pins
should connect to the input capacitor(s) ground.
+
0.1μF
1
MODE/PLLIN
SW
16
R FREQ
2
FREQ/PLLFLTR
TG
15
M1
C IN
C B
C SS
3
RUN
BOOST
LTC3851
14
V IN
4
TK/SS
V IN
13
D B
R C
C C
C C2
5
I TH
INTV CC
12
47pF
6
V FB
BG
11
+
4.7μF
M2
7
SENSE –
GND
10
–
1000pF
10Ω
8
SENSE +
I LIM
9
L1
10Ω
–
R1
R2
C OUT
R SENSE
V OUT
3851 F09
+
Figure 9. LTC3851 Layout Diagram
3851fb
22
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