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参数资料
| 型号： | LTC3854IDDB#TRPBF |
| 厂商： | Linear Technology |
| 文件页数： | 21/28页 |
| 文件大小： | 0K |
| 描述： | IC REG CTRLR BUCK PWM CM 12-DFN |
| 标准包装： | 2,500 |
| PWM 型： | 电流模式 |
| 输出数： | 1 |
| 频率 - 最大： | 440kHz |
| 占空比： | 98% |
| 电源电压： | 4.5 V ~ 38 V |
| 降压： | 是 |
| 升压： | 无 |
| 回扫： | 无 |
| 反相： | 无 |
| 倍增器： | 无 |
| 除法器： | 无 |
| Cuk： | 无 |
| 隔离： | 无 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 12-WFDFN 裸露焊盘 |
| 包装： | 带卷 (TR) |
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LTC3854
APPLICATIONS INFORMATION
L ? ? I L 2
2 ? ? V OUT ? V OUT
C OUT ≥
V OUT 1.2V
? I LOAD
ESR < 0.02 ? = 0.02 ? ≤ 5m ?
V OUT = 0.8 ? 1 + B ?
(
)
? (15A) 2 ? 1 + 0.005 ? ( 100°C – 25°C )
P MAIN =
? 13m ? + ( 20V ) ?
? 150pF
+
? ?
? ? f SW
However,theamountofcapacitanceneededisdetermined
not only by the allowed ripple in steady state but by the
maximum energy stored in the inductor. The capacitance
must be sufficient in value to absorb the change in induc-
tor current when a high current to low current transient
occurs. The minimum capacitance to assure the inductor’s
energy is adequately absorbed during a 5A load step for
a maximum overshoot of 2% is:
C OUT ≥
0.56μH ? (5A) 2
0.02 ? 1.2V
C OUT ≥ 583μF
A maximum overshoot or undershoot of 2% for a 5A load
step will require an ESR of:
5A
Several quality capacitors are available with low enough
ESR.
Multilayer ceramic capacitors tend to have very low ESR
values. It is also a good practice to reduce the ESL by putting
several capacitors in parallel on the output (a parallel bank
of larger and smaller capacitors will improve performance
in both a DC and a transient condition).
To keep ripple very low and design for any possible large
excursions in current 2x 330μF (tantalum or polymer
surface) and 1x 47μF polymer low ESR type were con-
nected in parallel.
Choosing FB Resistors (See Figure 3)
? R ?
? R A ?
Choosing C IN Capacitors
C IN is chosen for a RMS current rating of at least I OUT(MAX) /2
= 6A. Again, keeping ESR low will improve performance
and reduce power loss (several capacitors in parallel is
once again a good choice). We will use an 180μF 25V
electrolytic with 2x 10μF 25V low ESR ceramic capacitors
connected in parallel.
Choosing MOSFETs
The power dissipation in the main and synchronous FETs
can be easily estimated. Choosing a Renesas RJK0305DPB
for the main FET results in the following parameters:
BV DSS = 30V
R DS(ON) = 13m? maximum at 25°C, V GS = 4.5V
Q GD = 1.5nC at V DS , test 10V results in C MILLER = 1.5nC/10V
= 150pF
Q G = 8nC, typical, at V GS = 4.5V
V MILLER = 2.8V
At V IN = 20V, I OUT = 15A, estimated T J = 100°C for the
top FET and given
V INTVCC = 5.0V
R DR,PULLUP = 2.6?
R DR,PULLDOWN = 1.5?
the total losses in the main FET will be:
1.2V
20V
2 15A
2
? 2.5 ? 1.2 ? ?
? 5V ? 2.8V 2.8V ?
P MAIN = 0.55W
R B = 0.5R A
Using 1% 10.0k for R A gives 1% 4.99k for R B .
3854fb
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