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参数资料
| 型号： | M30623F8PGP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, FLASH, 24 MHz, MICROCONTROLLER, PQFP80 |
| 封装： | 14 X 14 MM, 0.65 MM PITCH, PLASTIC, QFP-80 |
| 文件页数： | 80/104页 |
| 文件大小： | 1313K |
| 代理商： | M30623F8PGP |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页当前第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页
5. Electrical Characteristics
Rev.2.41
Jan 10, 2006
Page 75 of 96
REJ03B0001-0241
Figure 5.15
Timing Diagram (3)
Memory Expansion Mode, Microprocessor Mode
(Effective for setting with wait)
BCLK
HOLD input
HLDA output
Measuring conditions :
VCC1=VCC2=3V
Input timing voltage : Determined with VIL=0.6V, VIH=2.4V
Output timing voltage : Determined with VOL=1.5V, VOH=1.5V
P0, P1, P2,
P3, P4,
P5_0 to P5_2 (1)
(Common to setting with wait and setting without wait)
NOTES:
1. These pins are set to high-impedance regardless of the input level of the
BYTE pin, PM06 bit in PM0 register and PM11 bit in PM1 register.
th(BCLKHOLD)
tsu(HOLDBCLK)
td(BCLKHLDA)
HiZ
RDY input
tsu(RDYBCLK)
th(BCLKRDY)
RD
BCLK
(Separate bus)
(Multiplexed bus)
WR, WRL, WRH
RD
(Separate bus)
WR, WRL, WRH
(Multiplexed bus)
VCC1=VCC2=3V
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