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参数资料
型号： M306H3FCFP
元件分类： 微控制器/微处理器
英文描述： 16-BIT, FLASH, 10 MHz, MICROCONTROLLER, PQFP116
封装： 20 X 20 MM, 0.65 MM PITCH, PLASTIC, LQFP-116
文件页数： 34/287页
文件大小： 2642K
代理商： M306H3FCFP
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Rev.1.00
2004.03.23
page 127 of 320
M306H3MC-XXXFP/FCFP
Start
bit
Parity
bit
TxDi
CTSi
“1”
“0”
“1”
“L”
“H”
“0”
“1”
Tc = 16 (n + 1) / fj or 16 (n + 1) / fEXT
fj : frequency of UiBRG count source (f1SIO, f2SIO, f8SIO, f32SIO)
fEXT : frequency of UiBRG count source (external clock)
n : value set to UiBRG
i: 0 to 2
“0”
“1”
TxDi
“0”
“1”
“0”
“1”
“0”
“1”
Transfer clock
Tc
“0”
“1”
Tc
Transfer clock
D0 D1
D2 D3 D4 D5 D6 D7
ST
P
D0 D1 D2 D3
D4 D5 D6
D7
SP
ST
P
SP
D0 D1
ST
Stop
bit
Start
bit
The transfer clock stops momentarily as CTSi is “H” when the stop bit is checked.
The transfer clock starts as the transfer starts immediately CTSi changes to “L”.
D0 D1 D2 D3 D4 D5 D6 D7
ST
SP
D8
D0 D1 D2 D3 D4 D5 D6 D7
ST
D8
D0 D1
ST
SPSP
Stop
bit
Stop
bit
“0”
SP
Stopped pulsing
because the TE bit
= “0”
Write data to the UiTB register
UiC1 register
TE bit
UiC1 register
TI bit
UiC0 register
TXEPT bit
SiTIC register
IR bit
Transferred from UiTB register to UARTi transmit register
The above timing diagram applies to the case where the register bits are set
as follows:
UiMR register PRYE bit = 1 (parity enabled)
UiMR register STPS bit = 0 (1 stop bit)
UiC0 register CRD bit = 0 (CTS/RTS enabled), CRS bit = 0 (CTS selected)
UiRS bit = 1 (an interrupt request occurs when transmit completed):
U0IRS bit is the UCON register bit 0, U1IRS bit is the UCON
register bit 1, and U2IRS bit is the U2C1 register bit 4
Cleared to “0” when interrupt request is accepted, or cleared to “0” in a program
UiC1 register
TE bit
UiC1 register
TI bit
UiC0 register
TXEPT bit
SiTIC register
IR bit
Cleared to “0” when interrupt request is accepted, or cleared to “0” in a program
Write data to the UiTB register
Transferred from UiTB register to UARTi
transmit register
Tc = 16 (n + 1) / fj or 16 (n + 1) / fEXT
fj : frequency of UiBRG count source (f1SIO, f2SIO, f8SIO, f32SIO)
fEXT : frequency of UiBRG count source (external clock)
n : value set to UiBRG
i: 0 to 2
The above timing diagram applies to the case where the register bits are set
as follows:
UiMR register PRYE bit = 0 (parity disabled)
UiMR register STPS bit = 1 (2 stop bits)
UiC0 register CRD bit = 1 (CTS/RTS disabled)
UiRS bit = 0 (an interrupt request occurs when transmit buffer becomes empty):
U0IRS bit is the UCON register bit 0, U1IRS bit is the UCON
register bit 1, and U2IRS bit is the U2C1 register bit 4
(1) Example of transmit timing when transfer data is 8 bits long (parity enabled, one stop bit)
(2) Example of transmit timing when transfer data is 9 bits long (parity disabled, two stop bits)
Figure 2.11.15. Transmit Operation
相关PDF资料
PDF描述
M306V5ME-XXXSP 16-BIT, MROM, 10 MHz, MICROCONTROLLER, PDIP64
M37150M6-XXXFP 8-BIT, MROM, 8.95 MHz, MICROCONTROLLER, PDSO42
M37151EFFP 8-BIT, OTPROM, 8.1 MHz, MICROCONTROLLER, PDSO42
M38203E4GP 8-BIT, OTPROM, 4 MHz, MICROCONTROLLER, PQFP80
M38503E4FP 8-BIT, OTPROM, 4 MHz, MICROCONTROLLER, PDSO42
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参数描述
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M306H5FGFP 制造商:RENESAS 制造商全称:Renesas Technology Corp 功能描述:SNGLE-CHIP 16-BIT CMOS MICROCOMPUTER with DATA ACQUISITION CONTROLLER
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M306H5MC-XXXFP 制造商:RENESAS 制造商全称:Renesas Technology Corp 功能描述:SNGLE-CHIP 16-BIT CMOS MICROCOMPUTER with DATA ACQUISITION CONTROLLER
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