参数资料
型号: M306H3FCFP
元件分类: 微控制器/微处理器
英文描述: 16-BIT, FLASH, 10 MHz, MICROCONTROLLER, PQFP116
封装: 20 X 20 MM, 0.65 MM PITCH, PLASTIC, LQFP-116
文件页数: 52/287页
文件大小: 2642K
代理商: M306H3FCFP
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Rev.1.00
2004.03.23
page 143 of 320
M306H3MC-XXXFP/FCFP
Table 2.11.15. Registers to Be Used and Settings in Special Mode 2
Register
Bit
Function
UiTB(Note3)
0 to 7
Set transmission data
UiRB(Note3) 0 to 7
Reception data can be read
OER
Overrun error flag
UiBRG
0 to 7
Set a transfer rate
UiMR(Note3) SMD2 to SMD0
Set to ‘0012
CKDIR
Set this bit to “0” for master mode or “1” for slave mode
IOPOL
Set to “0”
UiC0
CLK1, CLK0
Select the count source for the UiBRG register
CRS
Invalid because CRD = 1
TXEPT
Transmit register empty flag
CRD
Set to “1”
NCH
Select TxDi pin output format(Note 2)
CKPOL
Clock phases can be set in combination with the UiSMR3 register's CKPH bit
UFORM
Set to “0”
UiC1
TE
Set this bit to “1” to enable transmission
TI
Transmit buffer empty flag
RE
Set this bit to “1” to enable reception
RI
Reception complete flag
U2IRS (Note 1)
Select UART2 transmit interrupt cause
U2RRM(Note 1),
Set to “0”
U2LCH, UiERE
UiSMR
0 to 7
Set to “0”
UiSMR2
0 to 7
Set to “0”
UiSMR3
CKPH
Clock phases can be set in combination with the UiC0 register's CKPOL bit
NODC
Set to “0”
0, 2, 4 to 7
Set to “0”
UiSMR4
0 to 7
Set to “0”
UCON
U0IRS, U1IRS
Select UART0 and UART1 transmit interrupt cause
U0RRM, U1RRM
Set to “0”
CLKMD0
Invalid because CLKMD1 = 0
CLKMD1, RCSP, 7 Set to “0”
Note 1: Set the U0C0 and U1C1 register bit 4 and bit 5 to “0”. The U0IRS, U1IRS, U0RRM and U1RRM bits
are in the UCON register.
Note 2: TxD2 pin is N channel open-drain output. Set the U2C0 register's NCH bit to “0”.
Note 3: Not all register bits are described above. Set those bits to “0” when writing to the registers in Special
Mode 2.
i = 0 to 2
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