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参数资料
| 型号： | M306V2ME-XXXFP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, MROM, 10 MHz, MICROCONTROLLER, PQFP100 |
| 封装： | 14 X 20 MM, 0.65 MM PITCH, PLASTIC, QFP-100 |
| 文件页数： | 49/273页 |
| 文件大小： | 2352K |
| 代理商： | M306V2ME-XXXFP |
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Rev.1.40
Oct 06, 2004 page 140 of 269
M306V2ME-XXXFP, M306V2EEFP
(6) I2Ci status register (i = 0, 1)
The I2Ci status register controls the I2C-BUS interface i status. Bits 0 to 3, 5 are read-only bits and bits
4, 6, 7 can be read out and written to.
s Bit 0: last receive bit (LRB)
This bit stores the last bit value of received data and can also be used for ACK receive confirmation. If
ACK is returned when an ACK clock occurs, the LRB bit is set to “0.” If ACK is not returned, this bit is
set to “1.” Except in the ACK mode, the last bit value of received data is input. The state of this bit is
changed from “1” to “0” by executing a write instruction to the I2Ci data shift register or the I2Ci transmit
buffer register.
s Bit 1: general call detecting flag (AD0)
This bit is set to “1” when a general call whose address data is all “0” is received in the slave mode.
By a general call of the master device, every slave device receives control data after the general call.
The AD0 bit is set to “0” by detecting the STOP condition or START condition.
General call: The master transmits the general call address “0016” to all slaves.
s Bit 2: slave address comparison flag (AAS)
This flag indicates a comparison result of address data.
<<In the slave receive mode, when the 7-bit addressing format is selected, this bit is set to “1” in one
of the following conditions.>>
The address data immediately after occurrence of a START condition matches the slave address
stored in the high-order 7 bits of the I2Ci address register.
A general call is received.
<<In the slave reception mode, when the 10-bit addressing format is selected, this bit is set to “1” with
the following condition.>>
When the address data is compared with the I2Ci address register (8 bits consists of slave address
and RBW), the first bytes match.
<<The state of this bit is changed from “1” to “0” by executing a write instruction to the I2Ci data shift
register or the I2Ci transmit buffer register.>>
s Bit 3: arbitration lost detecting flag (AL)
n the master transmission mode, when a device other than the microcomputer sets the SDA to “L,”,
arbitration is judged to have been lost, so that this bit is set to “1.” At the same time, the TRX bit is set
to “0,” so that immediately after transmission of the byte whose arbitration was lost is completed, the
MST bit is set to “0.” When arbitration is lost during slave address transmission, the TRX bit is set to “0”
and the reception mode is set. Consequently, it becomes possible to receive and recognize its own
slave address transmitted by another master device.
Arbitration lost: The status in which communication as a master is disabled.
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PDF描述 |
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| M31002AMPJFREQ | VCXO, CLOCK, 150 MHz - 1400 MHz, PECL OUTPUT |
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