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参数资料
| 型号： | M37640E8FP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 24 MHz, MICROCONTROLLER, PQFP80 |
| 封装： | 14 X 20 MM, 0.80 MM PITCH, PLASTIC, QFP-80 |
| 文件页数： | 67/96页 |
| 文件大小： | 1477K |
| 代理商： | M37640E8FP |
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Ver 1.4
MITSUBISHI MICROCOMPUTERS
7640 Group
SINGLE-CHIP 8-BIT CMOS MICROCOMPUTER
7
1.10 CPU MODE REGISTERS
This device has two CPU mode registers:
CPU Mode Register A (CPMA)
CPU Mode Register B (CPMB)
These registers control the processor mode, clock,
slow memory wait and other CPU functions. The bit
representation of each register is described in Figure
1.5 and Figure 1.6.
Fig. 1.5. CPU Mode Register A (CPMA)
Fig.1.6. CPU Mode Register B (CPMB)
CPMA7
CPMA5 CPMA4 Reserved CPMA2 CPMA1 CPMA0
MSB
7
LSB
0
Address: 0000
16
Access: R/W
Reset: OC
16
CPMA6
CPMA0,1
Processor Mode Bits (bits 1,0)
Bit 1
Bit 0
0
0: Single-Chip Mode
0
1: Memory Expansion Mode
1
0: Microprocessor Mode
1
1: Not Used
CPMA2
Stack Page Selection Bit (bit 2)
0:
In page 0 area
1:
In page 1 area
CPMA3
Reserved (Read/Write “1”)
CPMA4
Clock XC
in - XCout Stop Bit (bit 4)
0:
Stop
1:
Oscillator
CPMA5
Clock X
in - Xout Stop Bit (bit 5)
0:
Oscillator
1:
Stop
CPMA6
Internal Clock Selection Bit (bit 6)
0:
External Clock
1:
f
syn
CPMA7
External Clock Selection Bit (bit 7)
0:
X
in - Xout
1:
XC
in - XCout
CPMB0,1
Slow Memory Wait Bits (bits 1,0)
Bit 1
Bit 0
0
0: No Wait
0
1: One time wait
1
0: Two time wait
1
1: Three time wait
CPMB2,3
Slow Memory Mode Bit (bit 3,2)
Bit 3
Bit 2
0
0: Software wait
0
1: Not used
1
0: Fixed wait by RDY pin L
1
1: Extended RDY wait
CPB4
Expanded Data Memory Access Bit (bit 4)
0:EDMA output disabled (64 Kbyte data access area)
1:EDMA output enabled (greater than 64 Kbytes data access area)
CPMB5
Hold Function Enable Bit (bit 5)
0:HOLD Function Disabled
1:HOLD Function Enabled
CPMB6
Reserved (Read/Write “0”)
CPMB7
Reserved (Read/Write “1”)
CPMB5 CPMB4
CPMB2 CPMB1 CPMB0
MSB
7
LSB
0
Address: 0001
16
Access: R/W
Reset: 83
16
CPMB3
Reser ved Reser ved
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