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参数资料
| 型号： | M38039FFHWG |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 8.4 MHz, MICROCONTROLLER, PBGA64 |
| 封装： | 6 X 6 MM, 0.65 MM PITCH, PLASTIC, FLGA-64 |
| 文件页数： | 18/117页 |
| 文件大小： | 1873K |
| 代理商： | M38039FFHWG |
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REVISION HISTORY
3803 Group (Spec.H) Data Sheet
Rev.
Date
Description
Page
Summary
First edition issued
Delete the following :“*:KP package is under development.”
Table 4 pin description
VCC,VSS Apply voltage of 2.7–5.5V
→ 1.8V–5.5V
Fig.5 Memory expansion plan
As of Dec. 2002
→ As of Mar. 2003
Notes
(address 3A16)
→ (address 003A16), (address 2316) → (address 002316),
(address 2A16)
→ (address 002A16), (address 3916) → (address 003916)
Fig.61 System clock generating circuit block diagram
Table 10 Recommended operating conditions
Add : VIL “L” input voltage XIN, XCIN 1.8
≤VCC≤5.5V Min. → 0
Table 11 Recommended operating conditions
f(XIN) High-speed mode f(
φ)=f(XIN)/2 2.2≤VCC≤4.0V → 2.7≤VCC≤4.0V
Table 16 A/D converter characteristics
VCC 8bit A/D mode, 10bit A/D mode Max. 5.0
→ 5.5
Table 17 D/A converter characteristics
VCC = 4.0 to 5.5V
→ 4.0≤VCC≤5.5V, VCC = 2.7 to 4.0V → 2.7≤VCC<4.0V
Table 16 A/D converter characteristics, Table 17 D/A converter characteristics
Resolution Unit Bits
→ bit
Table 18 Timing requirements (1) (In high-speed mode)
tC(XIN) Main clock XIN input cycle time 2.7
≤VCC<4.0
Min. 2.6
103/(82VCC-3) → 26103/(82VCC-3)
Table 18 Timing requirements (1) (In high-speed mode),
Table 20 Timing requirements (3) (In middle-speed mode)
tWH(XCIN) Sub-clock input “H” pulse width
→ Sub-clock XCIN input “H” pulse width
tWL(XCIN) Sub-clock input “L” pulse width
→ Sub-clock XCIN input “L” pulse width
Table 19 Timing requirements (2) (In high-speed mode),
Table 20 Timing requirements (4) (In middle-speed mode)
tCL(SCLK2)
→ tWL(SCLK2)
Fig.63 Timing diagram (in single-chip mode)
Delete the following underline parts :
SCLK1 SCLK2 SCLK3 tf , tr
TXD1 TXD3 SOUT2 td(SCLK1-TXD1), td(SCLK2-SOUT2), td(SCLK3-TXD3)
tv(SCLK1-TXD1), tv(SCLK2-SOUT2), tv(SCLK3-TXD3)
–
1,2,6,7
5
7
23
64
68
69
73
75
75,77
76,78
79
STP instruction
Timing
φ (internal clock)
S
R
Q
Middle-speed mode
High-speed or
low-speed mode
Main clock division ratio
selection bits (Note 1)
Prescaler 12
Timer 1
Reset or
STP instruction
(Note 2)
Divider
(Note 3)
FF16
0116
STP instruction
Timing
φ (internal clock)
S
R
Q
Middle-speed mode
High-speed or
low-speed mode
Main clock division ratio
selection bits (Note 1)
Prescaler 12
Timer 1
Reset or
STP instruction
(Note 2)
Divider
(Note 3)
Reset
1.00 Sep. 3, 2001
2.00 May. 28, 2003
3.00 Oct. 14, 2003
3.01 Jun.25, 2004
Flash memory version is added.
6
15
16
Table 5 Pin description is partly revised.
Figure 11 Memory map of special function register (SFR) is partly revised.
Table 8 I/O port function is partly revised.
REVISION HISTORY
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PDF描述 |
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| MPC8248VRTIEX | 32-BIT, 400 MHz, RISC PROCESSOR, PBGA516 |
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参数描述 |
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| M38039FFLKP#U0 | 制造商:Renesas 功能描述:MCU 8-bit 740 CISC 60KB Flash 3.3V/5V 64-Pin LQFP Tray |
| M38039FFLKPU0 | 制造商:Renesas Electronics Corporation 功能描述:8bit MCU,3803,61K ProgROM,2K RAM,LQFP64 |
| M38039FFSP | 制造商:Mitsubishi Electric 功能描述:8-BIT, FLASH, 8.4 MHz, MICROCONTROLLER, PDIP64 |
| M38039G4HHP#U0 | 功能描述:IC 740/3803 MCU QZROM 64LQFP RoHS:是 类别:集成电路 (IC) >> 嵌入式 - 微控制器， 系列:740/38000 标准包装:250 系列:80C 核心处理器:8051 芯体尺寸:8-位 速度:16MHz 连通性:EBI/EMI，I²C，UART/USART 外围设备:POR，PWM，WDT 输入/输出数:40 程序存储器容量:- 程序存储器类型:ROMless EEPROM 大小:- RAM 容量:256 x 8 电压 - 电源 (Vcc/Vdd):4.5 V ~ 5.5 V 数据转换器:A/D 8x10b 振荡器型:内部 工作温度:-40°C ~ 85°C 封装/外壳:68-LCC（J 形引线） 包装:带卷 (TR) |
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