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参数资料
| 型号： | M38049FFHKP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 8.4 MHz, MICROCONTROLLER, PQFP64 |
| 封装： | 14 X 14 MM, 0.80 MM PITCH, PLASTIC, LQFP-64 |
| 文件页数： | 102/118页 |
| 文件大小： | 1202K |
| 代理商： | M38049FFHKP |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页当前第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页
Rev.1.01
Jan 25, 2005
page 82 of 114
REJ03B0131-0101Z
3804 Group (Spec. H)
Fig. 81 CPU rewrite mode set/release flowchart
Figure 81 shows a flowchart for setting/releasing CPU rewrite
mode.
Fig. 80 Structure of flash memory control register 2
Table 14 State of E/W inhibition function
All user block E/W
enable bit
0
1
8 KB user block E/W
enable bit
0
1
0
1
8 KB 2 block
Addresses C00016 to FFFF16
E/W disabled
E/W enabled
16 KB + 24 KB block
Addresses 200016 to BFFF16
E/W disabled
E/W enabled
Data block
Addresses 100016 to 1FFF16
E/W enabled
Notes 1:
For this bit to be set to
“1”, the user needs to write a
“
0” and then a
“1” to it in succession. For this bit to be set to “0”, write
“
0” only to
this bit.
2:
Effective only when the CPU rewrite mode select bit =
“
1”.
b7
b0
Not used
Not used (do not write
“ 1 ”
to this bit.)
All user block E/W enable bit (Notes 1, 2)
0 :
E/W disabled
1 :
E/W enabled
Flash memory control register 2
(FMCR2: address : 0FE216: initial value: 4516)
Not used
End
Start
Execute read array command (Note 2)
Single-chip mode or Boot mode
Set CPU mode register (Note 1)
Using software command executes erase,
program, or other operation
Jump to control program transferred to internal
RAM
(Subsequent operations are executed by control
program in this RAM)
Transfer CPU rewrite mode control program to
internal RAM
Notes 1: Set the main clock as follows depending on the clock division ratio selection bits of CPU
mode register (bits 6, 7 of address 003B16).
2 : Before exiting the CPU rewrite mode after completing erase or program operation, always
be sure to execute the read array command.
Write “0” to CPU rewrite mode select bit
Set CPU rewrite mode select bit to “1” (by
writing “0” and then “1” in succession)
Set all user block E/W enable bit to “1”
(by writing “0” and then “1” in succession)
Set 8 KB user block E/W enable bit
(At E/W disabled; writing “0”, at E/W enabled;
writing “0” and then “1” in succession)
Set all user block E/W enable bit to “0”
Set 8 KB user block E/W enable bit to “0”
相关PDF资料 |
PDF描述 |
|---|---|
| M38227M8HXXXFP | 8-BIT, MROM, 4 MHz, MICROCONTROLLER, PQFP80 |
| MPC603RZT200TX | 32-BIT, 200 MHz, RISC PROCESSOR, PBGA255 |
| MB90423GBPF | 16-BIT, MROM, 16 MHz, MICROCONTROLLER, PQFP100 |
| MC68HC705F6B/K | 8-BIT, OTPROM, MICROCONTROLLER, PDIP42 |
| MK2069-02GI | 160 MHz, OTHER CLOCK GENERATOR, PDSO56 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| M38049FFLHP#U0 | 制造商:Renesas Electronics Corporation 功能描述: |
| M38049RLSS | 功能描述:DEV EMULATOR CHIP RAM 2KB 64SDIP RoHS:否 类别:编程器，开发系统 >> 内电路编程器、仿真器以及调试器 系列:- 产品变化通告:Development Systems Discontinuation 19/Jul/2010 标准包装:1 系列:* 类型:* 适用于相关产品:* 所含物品:* |
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| M3806 BK001 | 制造商:Alpha Wire Company 功能描述:CBL 8COND 18AWG BLK 1000' |
| M3806 BK002 | 制造商:Alpha Wire Company 功能描述:CBL 8COND 18AWG BLK 500' |
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