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参数资料
| 型号： | M38K09F8LHP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 12 MHz, MICROCONTROLLER, PQFP64 |
| 封装： | 10 X 10 MM, 0.50 MM PITCH, PLASTIC, LQFP-64 |
| 文件页数： | 92/133页 |
| 文件大小： | 1359K |
| 代理商： | M38K09F8LHP |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页当前第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页
38K0 Group
Rev.3.00
Oct 05, 2006
page 61 of 129
REJ03B0192-0300
b7
b0
–
RXBUF/
TXBUF
–
0
Index =0116 : Transmit/Receive buffer register (RXBUF/TXBUF) [address 003416]
Bit name
Bit symbol
At reset
Function
H/W
S/W
OO
The data received from an external bus is written here
at the rise timing of external write signal.
The data transmitted to an external bus is written here
at the timing of internal CPU write or memory write.
The receive buffer register (RXBUF) contents can be read out by reading to this address with the CPU. The data which the
CPU has written to this address is stored in the transmit buffer register (TXBUF).
However, do not perform write operation with the CPU to this address if the memory channel direction control bits of
memory channel operation mode register is “102” (transmit mode) and the memory channel status bits of EXB interrupt
source register are “012” or “102” (memory channel being operating).
W
R
Fig. 86 Index01[low]; Structure of Transmit/Receive buffer register
b7
b0
MC_DIR
[1:0]
BURST
b7:b3
–
0
–
Index =0216 : Memory channel operation mode register (MCHMOD) [address 003416]
00000
Bit name
Bit symbol
At reset
Function
H/W
S/W
b1b0
0 0 : Operation disabled
0 1 : Receive mode
1 0 : Transmit mode
1 1 : Do not set.
0 : Cycle mode (each byte transfer according to
assertion or negation)
1 : Burst mode (continuous transfer till the terminal
count)
Write “0” when writing.
“0” is read when reading.
O
–: State remaining
Memory channel direction
control bit
Burst bit
Not used
W
R
Fig. 87 Index02[low]; Structure of Memory channel operation mode register
b7
b0
IM_A
[7:0]
–
0
Index = 0316 : Memory address counter (MEMADL) [address 003416]
Bit name
Bit symbol
At reset
Function
H/W
S/W
OO
–
Register to set the low-order address of memory
channel operation beginning.
This contents are increased each time one memory
access ends.
W
R
Fig. 88 Index03[low]; Structure of Memory address counter
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PDF描述 |
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